- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄1924 > IDT82P2288BBG (IDT, Integrated Device Technology Inc)TXRX OCTAL T1/E1/J1 256-PBGA PDF資料下載
參數(shù)資料
| 型號： | IDT82P2288BBG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 355/362頁 |
| 文件大?。?/td> | 0K |
| 描述： | TXRX OCTAL T1/E1/J1 256-PBGA |
| 標準包裝： | 10 |
| 類型： | 收發(fā)器 |
| 規(guī)程： | IEEE 1149.1 |
| 電源電壓： | 3 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-BBGA |
| 供應(yīng)商設(shè)備封裝： | 256-PBGA（17x17） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 1259 (CN2011-ZH PDF) |
| 其它名稱： | 800-1701 82P2288BBG |
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IDT82P2288
OCTAL T1/E1/J1 LONG HAUL / SHORT HAUL TRANSCEIVER
Functional Description
92
March 04, 2009
3.20.1.2 E1 Mode
In E1 mode, the Frame Generator can generate Basic Frame, CRC-4
Multi-Frame and Channel Associated Signaling (CAS) Multi-Frame. The
Frame Generator can also transmit alarm indication signal when special
conditions occurs in the received data stream. International bits,
National bits and Extra bits replacements and data inversions are all
supported in the Frame Generator.
The generation of the Basic frame, CRC Multi-Frame and Channel
Associated Signaling (CAS) Multi-Frame are controlled by the FDIS bit,
the GENCRC bit, the CRCM bit and the SIGEN bit. Refer to Table 47 for
details.
When the Basic frame is generated, the Frame Alignment Sequence
(FAS) (‘0011011’) will replace the Bit 2 ~ Bit 8 of TS0 of each even
frame; the NFAS bit (‘1’) will replace the Bit 2 of TS0 of each odd frame.
If the FAS1INV bit is set, one FAS bit will be inverted; if the FASALLINV
bit is set, one 7-bit FAS pattern will be inverted; if the NFASINV bit is set,
one NFAS bit will be inverted.
When the Basic frame is generated, if the SiDIS bit is ‘0’, the value
set in the Si[1] and Si[0] bits will replace the International bit (Bit 1) of
FAS frame and NFAS frame respectively.
When the Basic frame is generated, the Remote Alarm Indication
(RAI) can be transmitted as logic 1 in the A bit position. It is transmitted
manually when the REMAIS bit is ‘1’. It can also be transmitted automat-
ically when the AUTOYELLOW bit is set to ‘1’. In this case, the RAI
transmission criteria are selected by the G706RAI bit.
When the Basic frame is generated, the setting in the SaX[1] bit will
be transmitted in the Sa bit position if enabled by the corresponding
SaXEN bit (‘X’ is from 4 to 8).
The CRC Multi-Frame is generated on the base of the Basic frame
generation. When it is generated, the CRC Multi-Frame alignment
pattern (‘001011’) will replace the Bit 1 of TS0 of the first 6 odd frames;
the calculated 4-bit CRC of the previous Sub-Multi-Frame will be
inserted in the CRC-bit positions of the current Sub-Multi-Frame. The
CRC-bit position is the Bit 1 of TS0 of each even frame. Refer to
Table 18 for the CRC Multi-Frame structure. If the CRCPINV bit is set,
one 6-bit CRC Multi-Frame alignment pattern will be inverted; if the
CRCINV bit is set, all 4 calculated CRC bits in one Sub-Multi-Frame will
be inverted.
When the CRC Multi-Frame is generated, since 14 International bit
positions have been occupied by the CRC Multi-Frame alignment
pattern and CRC-4 checking bits, the remaining 2 International bit posi-
tions are inserted by the E bits. The control over the E bits is illustrated
in Table 48.
When the CRC Multi-Frame is generated, the setting in the SaX[1:4]
bits will be transmitted in the Sa bit position if enabled by the corre-
sponding SaXEN bit (‘X’ is from 4 to 8).
The Channel Associated Signaling (CAS) Multi-Frame is generated
on the base of the Basic frame generation. When it is generated, the
Signaling Multi-Frame alignment pattern (‘0000’) will replace the high
nibble (Bit 1 ~ Bit 4) of TS16 of every 16 Basic frames. If the CASPINV
bit is set, one 4-bit Signaling Multi-Frame alignment pattern will be
inverted.
When the Signaling Multi-Frame is generated, if the XDIS bit is ‘0’,
the value set in the FGEN Extra register will be inserted into the Extra
bits (the Bit 5, 7 & 8 of TS16 of Frame 0 of the Signaling Multi-Frame).
When the Signaling Multi-Frame is generated, the value in the
MFAIS bit will be continuously transmitted in the Y bit position (the Bit 6
of TS16 of Frame 0 of the Signaling Multi-Frame).
When the Signaling Multi-Frame is generated, all the bits in TS16
can be overwritten by all ‘Zero’s or all ’One’s by setting the TS16LOS bit
or the TS16AIS bit respectively. The all zeros overwritten takes a higher
priority.
Table 47: E1 Frame Generation
Desired Frame Type
FDI
S
GENCR
C
CRC
M
SIGE
N
Basic Frame
00
X
01
0
X
CRC Multi-Frame
0
1
0
X
Modified CRC Multi-Frame
0
1
X
Channel Associated Signaling (CAS)
Multi-Frame
00
X
1
01
0
1
Table 48: Control Over E Bits
FEBEDIS
OOCMFV
SiDIS
E Bits Insertion
00
X
A single zero is inserted into the E bit when a CRC-4 Error event is detected in the receive path. (the E1 bit corresponds to
SMFI and the E2 bit corresponds to SMFII)
0
1
X
The value in the Si[1] bit is inserted into the E1 bit position. The value in the Si[0] bit is inserted into the E2 bit position.
1
X
0
The value in the Si[1] bit is inserted into the E1 bit position. The value in the Si[0] bit is inserted into the E2 bit position.
1
X
1
The E bit positions are unchanged.
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PDF描述 |
|---|---|
| IDT82P2521BHG | IC LIU E1 21+1CH SHORT 640-PBGA |
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| IDT82P2521BH | 功能描述:IC LIU E1 21+1CH SHORT 640-PBGA RoHS:否 類別:集成電路 (IC) >> 接口 - 驅(qū)動器，接收器，收發(fā)器 系列:- 標準包裝:250 系列:- 類型:收發(fā)器 驅(qū)動器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:帶卷 (TR) |
| IDT82P2521BHBLANK | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:21(1) Channel High-Density E1 Line Interface Unit |
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