參數(shù)資料
型號(hào)： IDT82V3255
廠商： Integrated Device Technology, Inc.
英文描述： WAN PLL
中文描述： 廣域網(wǎng)鎖相環(huán)
文件頁數(shù)： 118/127頁
文件大?。?/td> 868K
代理商： IDT82V3255
IDT82V3255
WAN PLL
Electrical Specifications
118
June 19, 2006
Table 46: Output Clock Phase Noise
Output Clock
1
@100Hz Offset
Typ
@1kHz Offset
Typ
@10kHz Offset
Typ
@100kHz Offset
Typ
@1MHz Offset
Typ
@5MHz Offset
Typ
Unit
622.08 MHz (T0 DPLL + T0/T4 APLL)
155.52 MHz (T0 DPLL + T0/T4 APLL)
38.88 MHz (T0 DPLL + T0/T4 APLL)
16E1 (T0/T4 APLL)
16T1 (T0/T4 APLL)
E3 (T0/T4 APLL)
T3 (T0/T4 APLL)
Note:
1.
CMAC E2747 TCXO is used.
-70
-82
-94
-94
-95
-93
-92
-86
-98
-110
-110
-112
-109
-108
-95
-107
-118
-118
-120
-116
-116
-100
-112
-124
-125
-127
-124
-122
-107
-119
-131
-131
-132
-131
-126
-128
-140
-143
-142
-143
-138
-141
dBC/Hz
dBC/Hz
dBC/Hz
dBC/Hz
dBC/Hz
dBC/Hz
dBC/Hz
Table 47: Input Jitter Tolerance (155.52 MHz)
Jitter Frequency
12
μ
Hz
178
μ
Hz
1.6 mHz
15.6 mHz
0.125 Hz
19.3 Hz
500 Hz
6.5 kHz
65 kHz
1.3 MHz
Jitter Tolerance Amplitude (UI p-p)
> 2800
> 2800
> 311
> 311
> 39
> 39
> 1.5
> 1.5
> 0.15
> 0.15
Table 48: Input Jitter Tolerance (1.544 MHz)
Jitter Frequency
Jitter Tolerance Amplitude (UI p-p)
1 Hz
5 Hz
20 Hz
300 Hz
400 Hz
700 Hz
2400 Hz
10 kHz
40 kHz
150
140
130
38
25
15
5
1.2
0.5
Table 49: Input Jitter Tolerance (2.048 MHz)
Jitter Frequency
Jitter Tolerance Amplitude (UI p-p)
1 Hz
5 Hz
20 Hz
300 Hz
400 Hz
700 Hz
2400 Hz
10 kHz
50 kHz
100 kHz
150
140
130
40
33
18
5.5
1.3
0.4
0.4
Table 50: Input Jitter Tolerance (8 kHz)
Jitter Frequency
Jitter Tolerance Amplitude (UI p-p)
1 Hz
5 Hz
20 Hz
300 Hz
400 Hz
700 Hz
2400 Hz
3600 Hz
0.8
0.7
0.6
0.16
0.14
0.07
0.02
0.01
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