參數(shù)資料
型號： IDTCV110NPVG8
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 14/16頁
文件大?。?/td> 0K
描述： IC FLEXPC CLK PROGR P4 56-SSOP
產品變化通告： Product Discontinuation 19/Jul/2010
標準包裝： 1,000
系列： FlexPC™
類型： 時鐘/頻率發(fā)生器
PLL： 是
主要目的： Intel CPU，SATA CPU
輸入： 晶體
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:20
差分 - 輸入:輸出： 無/是
頻率 - 最大： 400MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 56-BSSOP（0.295"，7.50mm 寬）
供應商設備封裝： 56-SSOP
包裝： 帶卷 (TR)
其它名稱： CV110NPVG8
COMMERCIALTEMPERATURERANGE
IDTCV110N
PROGRAMMABLEFLEXPCCLOCKFORP4PROCESSOR
7
BYTE 4
Bit
Output(s) Affected
Description / Function
0
1
Type
Power On
0
Reserve
RW
1
Reserve
RW
1
2
Reserve
RW
1
3
PCIF0
Allow controlled by software
Notstopped
Stoppedwith
RW
0
PCI_STOP, byte 6, bit 3, assertion
by PCI_STOP
PCI_STOP
4
PCIF1
Allow controlled by software
Notstopped
Stoppedwith
RW
0
PCI_STOP, byte 6, bit 3, assertion
by PCI_STOP
PCI_STOP
5
PCIF2
Allow controlled by software
Notstopped
Stoppedwith
RW
0
PCI_STOP, byte 6, bit 3, assertion
by PCI_STOP
PCI_STOP
6
DOT96
DOT96 power down drive mode
Driven in power down
Tristate
RW
0
7
Reserve
0
BYTE 5
Bit
Output(s) Affected
Description / Function
0
1
Type
Power On
0
CPU0, CPU0#
CPU0 PWRDWN drive mode
Driven in power down
Tristate in power down
RW
0
1
CPU1, CPU1#
CPU1 PWRDWN drive mode
Driven in power down
Tristate in power down
RW
0
2
CPU2, CPU2#
CPU2 PWRDWN drive mode
Driven in power down
Tristate in power down
RW
0
3
SRC[7:1], SRC[7:1]#
SRC PWRDWN drive mode
Driven in power down
Tristate in power down
RW
0
4
Reserve
0
5
Reserve
0
6
Reserve
0
7
SRC[7:1], SRC[7:1]#
SRC PCI_STOP drive mode
Driven in PCI_STOP
Tristatewhenstopped
RW
0
BYTE 3
Bit
Output(s) Affected
Description / Function
0
1
Type
Power On
0
Reserve
1
SRC1
Allow controlled by software
Freerunning,not
Stoppedwith
RW
0
PCI_STOP, byte 6, bit 3, assertion
affected by PCI_STOP
PCI_STOP
2
SRC2
Allow controlled by software
Freerunning,not
Stoppedwith
RW
0
PCI_STOP, byte 6, bit 3, assertion
affected by PCI_STOP
PCI_STOP
3
SRC3
Allow controlled by software
Freerunning,not
Stoppedwith
RW
0
PCI_STOP, byte 6, bit 3, assertion
affected by PCI_STOP
PCI_STOP
4
SRC4
Allow controlled by software
Freerunning,not
Stoppedwith
RW
0
PCI_STOP, byte 6, bit 3, assertion
affected by PCI_STOP
PCI_STOP
5
SRC5
Allow controlled by software
Freerunning,not
Stoppedwith
RW
0
PCI_STOP, byte 6, bit 3, assertion
affected by PCI_STOP
PCI_STOP
6
SRC6
Allow controlled by software
Freerunning,not
Stoppedwith
RW
0
PCI_STOP, byte 6, bit 3, assertion
affected by PCI_STOP
PCI_STOP
7
SRC7
Allow controlled by software
Freerunning,not
Stoppedwith
RW
0
PCI_STOP, byte 6, bit 3, assertion
affected by PCI_STOP
PCI_STOP
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PDF描述
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