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參數(shù)資料
| 型號： | IDTCV115-2PV8 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 10/19頁 |
| 文件大小： | 0K |
| 描述： | IC FLEXPC CLK PROGR P4 56-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | FlexPC™ |
| 類型： | 時鐘/頻率發(fā)生器，多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | Intel CPU，SATA CPU |
| 輸入： | 晶體 |
| 輸出： | 時鐘 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:21 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 400MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 56-BSSOP（0.295"，7.50mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 56-SSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | CV115-2PV8 |
COMMERCIALTEMPERATURERANGE
18
IDTCV115-2
PROGRAMMABLEFLEXPCCLOCKFORP4PROCESSOR
PD#DE-ASSERTION
The time from the de-assertion of PD# or until power supply ramps to get stable clocks will be less than 1.8ms. If the drive mode control bit for PD# tristate
is programmed to ‘1’ the stopped differential pair must first be driven high to a minimum of 200mV in less than 300s of PD# deassertion.
PWRDWN#
CPU 133MHz
CPU# 133MHz
SRC 100MHz
SRC# 100MHz
USB 48MHz
PCI 33MHz
REF 14.31818
tSTABLE <1.8mS
tDRIVE_PWRDWN#
<300
μS, <200mV
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PDF描述 |
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參數(shù)描述 |
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| IDTCV115C | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR |
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