參數(shù)資料
型號(hào)： IDTCV125PAG
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： XO, clock
英文描述： PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR
中文描述： 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
封裝： LEAD FREE, TSSOP-56
文件頁(yè)數(shù)： 7/24頁(yè)
文件大小： 159K
代理商： IDTCV125PAG
COMMERCIAL TEMPERATURE RANGE
IDTCV125
PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR
7
BY TE 3
Bit
Output(s) Affected
Reserved
SRC1
SRC2
SRC3
SRC4
SRC5
SRC6
SRC7
Description / Function
0
1
Type
RW
RW
RW
RW
RW
RW
RW
RW
Power On
0
0
0
0
0
0
0
0
0
1
2
3
4
5
6
7
Allow controlled by
PCI_STOP#assertion
Free running, not
affected by PCI_STOP#
Stopped with
PCI_STOP#
BY TE 5
Bit
Output(s) Affected
CPU0, CPU0#
CPU1, CPU1#
CPU2, CPU2#
SRC[7:1], SRC[7:1]#
CPU0, CPU0#
CPU1, CPU1#
CPU2, CPU2#
SRC[7:1], SRC[7:1]#
Description / Function
CPU0 PD drive mode
CPU1 PD drive mode
CPU2 PD drive mode
SRC PD drive mode
CPU0 CPU_STOP drive mode
CPU1 CPU_STOP drive mode
CPU2 CPU_STOP drive mode
SRC PCI_STOP drive mode
0
1
Type
RW
RW
RW
RW
RW
RW
RW
RW
Power On
0
0
0
0
0
0
0
0
0
1
2
3
4
5
6
7
Driven in power down
Driven in power down
Driven in power down
Driven in power down
Driven in CPU_STOP#
Driven in CPU_STOP#
Driven in CPU_STOP#
Driven in PCI_STOP
Tristate in power down
Tristate in power down
Tristate in power down
Tristate in power down
Tristate when stopped
Tristate when stopped
Tristate when stopped
Tristate when stopped
BY TE 4
Bit
Output(s) Affected
CPU0, CPU0#
Description / Function
Allow control of CPU0
with assertion of CPU_STOP#
Allow control of CPU1
with assertion of CPU_STOP#
Allow control of CPU2
with assertion of CPU_STOP#
Allow controlled by
PCI_STOP#assertion
0
1
Type
RW
Power On
1
0
Not stopped
by CPU_STOP#
Not stopped
by CPU_STOP#
Not stopped
by CPU_STOP#
Not stopped
by PCI_STOP#
Stopped with
CPU_STOP#
Stopped with
CPU_STOP#
Stopped with
CPU_STOP#
Stopped with
PCI_STOP#
1
CPU1, CPU1#
RW
1
2
CPU2, CPU2#
RW
1
3
4
5
6
7
PCIF0
PCIF1
Reserved
DOT96
Reserved
RW
RW
RW
RW
RW
0
0
0
0
0
DOT96 power down drive mode
Driven in power down
Tristate
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PDF描述
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參數(shù)描述
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