參數(shù)資料
型號(hào)： IDTCV128PV
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時(shí)鐘及定時(shí)
英文描述： CV128 SERIES, PLL BASED CLOCK DRIVER, 12 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO56
封裝： SSOP-56
文件頁(yè)數(shù)： 9/12頁(yè)
文件大小： 77K
代理商： IDTCV128PV
COMMERCIALTEMPERATURERANGE
6
IDTCV128
1-TO-12DIFFERENTIALCLOCKBUFFER
BYTE 2
Bit
Output(s)Affected
Description/Function
0
1
Type
Power On
7
Reserved
RW
1
6
PLL_BW#adjust
0 = HIGH BW
1 = LOW BW
RW
1
5
BYPASS# test mode / PLL
0 = Bypass
1 = PLL
RW
1
4
Reserved
RW
1
3
DIF_11
OutputEnable
Tristate
Enable
RW
1
2
DIF_10
OutputEnable
Tristate
Enable
RW
1
DIF_9
OutputEnable
Tristate
Enable
RW
1
0
DIF_8
OutputEnable
Tristate
Enable
RW
1
BYTE 3
Bit
Output(s)Affected
Description / Function
0
1
Type
Power On
7
Readback - OE#_7 Input
Dependsonthestateofpin
R
6
Readback - OE#_6 Input
Dependsonthestateofpin
R
5
Readback - OE#_5 Input
Dependsonthestateofpin
R
4
Readback - OE#_4 Input
Dependsonthestateofpin
R
3
Readback - OE#_3 Input
Dependsonthestateofpin
R
2
Readback - OE#_2 Input
Dependsonthestateofpin
R
1
Readback - OE#_1 Input
Dependsonthestateofpin
R
0
Readback - OE#_0 Input
Dependsonthestateofpin
R
BYTE 0
Bit
Output(s)Affected
Description/Function
0
1
Type
Power On
7
Group of 10 gear #
GRselection
1:1 = In
RW
1
DIF [9:0] Speed selection
6
Group of 2 gear #
GRselection
1:1 = In
RW
1
DIF[11:10]Speedselection
5
Reserved
RW
1
4
FSAlatchedinput
RW
3
SMBus3
RW
2
SMBus2
seeGearRatiotable
RW
1
SMBus1
RW
0
SMBus0
RW
BYTE 1
Bit
Output(s)Affected
Description/Function
0
1
Type
Power On
7
DIF_7
OutputEnable
Tri-State
Enable
RW
1
6
DIF_6
OutputEnable
Tri-State
Enable
RW
1
5
DIF_5
OutputEnable
Tri-State
Enable
RW
1
4
DIF_4
OutputEnable
Tri-State
Enable
RW
1
3
DIF_3
OutputEnable
Tri-State
Enable
RW
1
2
DIF_2
OutputEnable
Tri-State
Enable
RW
1
DIF_1
OutputEnable
Tri-State
Enable
RW
1
0
DIF_0
OutputEnable
Tri-State
Enable
RW
1
CONTROLREGISTERS
相關(guān)PDF資料
PDF描述
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相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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