參數(shù)資料
型號： IDTCV143PYG8
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時鐘及定時
英文描述： CV143 SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28
封裝： GREEN, SSOP-28
文件頁數(shù)： 1/10頁
文件大小： 78K
代理商： IDTCV143PYG8
COMMERCIALTEMPERATURERANGE
IDTCV143
1-TO-4DIFFERENTIALCLOCKBUFFER
1
OCTOBER 2005
IDTCV143
COMMERCIAL TEMPERATURE RANGE
1-TO-4 DIFFERENTIAL
CLOCK BUFFER
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
2005 Integrated Device Technology, Inc.
DSC-6739/17
FEATURES:
Compliant with Intel DB400 spec
Four differential clock pairs at 0.7V
50ps skew
50ps cycle-to-cycle jitter
Programmable Bandwidth
PLL bypass configurable
Available in SSOP package
FUNCTIONAL BLOCK DIAGRAM
DESCRIPTION:
The CV143 differential buffer is compliant with Intel DB400 specifications. It
is intended to distribute the SRC (serial reference clock) as a companion chip
to the main clock of the CK409, CK410/CK410M, CK410B , etc. PLL is off in
bypass mode and has no clock detect.
DIV
PLL
DIF_1
DIF_1#
DIF_2
DIF_2#
DIF_5
DIF_5#
DIF_6
DIF_6#
Output
Buffer
SCL
SDA
SRC_IN#
SRC_IN
Output
Control
HIGH_BW#
PLL/BYPASS#
OE_1, OE_6
SRC_STOP
PWRDWN
SM Bus
Controller
OE_INV
(1)
NOTE:
1. See OE_INV table for active HIGH or active LOW.
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