參數(shù)資料
型號(hào)： IDTQS3VH126Q8
廠(chǎng)商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類(lèi)： 總線(xiàn)收發(fā)器
英文描述： CB3Q/3VH/3C/2B SERIES, QUAD 1-BIT DRIVER, TRUE OUTPUT, PDSO16
封裝： QSOP-16
文件頁(yè)數(shù)： 7/8頁(yè)
文件大小： 75K
代理商： IDTQS3VH126Q8
7
INDUSTRIALTEMPERATURERANGE
IDTQS3VH126
2.5V / 3.3V QUAD ACTIVE HIGH, HIGH BANDWIDTH SWITCH
Open
VLOAD
GND
VCC
Pulse
Generator
D.U.T.
500
Ω
500
Ω
CL
RT
VIN
VOUT
(1, 2)
SAM E PH ASE
IN PU T TRANSITION
O PPOSITE PH ASE
IN PUT TR AN SITION
0V
VOH
VOL
tPLH
tPHL
tPLH
OU TPUT
VIH
VT
VIH
VT
CONTRO L
IN PU T
tPLZ
0V
OUTPUT
NORMALLY
LOW
tPZH
0V
SW ITCH
CLO SED
OUTPU T
NORMALLY
HIGH
EN ABLE
D ISABLE
SW ITCH
OPEN
tPHZ
0V
V OL + VLZ
V OH
VT
tPZL
VLOAD/2
VLO AD/2
VIH
V T
V OL
V OH -V HZ
TEST CIRCUITS AND WAVEFORMS
TEST CONDITIONS
Symbol
VCC(1)= 3.3V ± 0.3V
VCC(2)= 2.5V ± 0.2V
Unit
VLOAD
6
2 x Vcc
V
VIH
3
Vcc
V
VT
1.5
VCC/2
V
VLZ
300
150
mV
VHZ
300
150
mV
CL
50
30
pF
NOTE:
1. Diagram shown for input Control Enable-LOW and input Control Disable-HIGH.
NOTES:
1. Pulse Generator for All Pulses: Rate
≤ 10MHz; tF ≤ 2.5ns; tR ≤ 2.5ns.
2. Pulse Generator for All Pulses: Rate
≤ 10MHz; tF ≤ 2ns; tR ≤ 2ns.
DEFINITIONS:
CL = Load capacitance: includes jig and probe capacitance.
RT = Termination resistance: should be equal to ZOUT of the Pulse Generator.
SWITCH POSITION
Test
Switch
tPLZ/tPZL
VLOAD
tPHZ/tPZH
GND
tPD
Open
Propagation Delay
Test Circuits for All Outputs
Enable and Disable Times
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PDF描述
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