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參數(shù)資料
| 型號(hào)： | IS61NLF51218 |
| 廠商： | Integrated Silicon Solution, Inc. |
| 英文描述： | SRAM |
| 中文描述： | 靜態(tài)存儲(chǔ)器 |
| 文件頁數(shù)： | 7/20頁 |
| 文件大小： | 155K |
| 代理商： | IS61NLF51218 |
Integrated Silicon Solution, Inc.
—
1-800-379-4774
PRELIMINARY INFORMATION
Rev. 00D
04/26/01
7
IS61NF25632
IS61NLF25632
IS61NF25636
IS61NLF25636
IS61NF51218
IS61NLF51218
ISSI
ASYNCHRONOUS TRUTH TABLE
(1)
Operation
ZZ
OE
I/O STATUS
Sleep Mode
H
L
L
L
L
X
L
H
X
X
High-Z
DQ
High-Z
Din, High-Z
High-Z
Read
Write
Deselected
Notes:
1. X means "Don't Care".
2. For write cycles following read cycles, the output buffers must be disabled with
OE
,
otherwise data bus contention will occur.
3. Sleep Mode means power Sleep Mode where stand-by current does not depend on cycle
time.
4. Deselected means power Sleep Mode where stand-by current depends on cycle time.
WRITE TRUTH TABLE
(x18)
Operation
WE
BW
a
BW
b
READ
WRITE BYTE a
WRITE BYTE b
WRITE ALL BYTEs
WRITE ABORT/NOP
Notes:
1. X means "Don't Care".
2. All inputs in this table must beet setup and hold time around the rising edge of CLK.
H
L
L
L
L
X
L
H
L
H
X
H
L
L
H
WRITE TRUTH TABLE
(x32/x36)
Operation
WE
BW
a
BW
b
BW
c
BW
d
READ
WRITE BYTE a
WRITE BYTE b
WRITE BYTE c
WRITE BYTE d
WRITE ALL BYTEs
WRITE ABORT/NOP
Notes:
1. X means "Don't Care".
2. All inputs in this table must beet setup and hold time around the rising edge of CLK.
H
L
L
L
L
L
L
X
L
H
H
H
L
H
X
H
L
H
H
L
H
X
H
H
L
H
L
H
X
H
H
H
L
L
H
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IS61NP12832-133TQ | PIPELINE NO WAIT STATE BUS SRAM |
| IS61NLP12832 | PIPELINE NO WAIT STATE BUS SRAM |
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| IS61NLP12832-133TQ | PIPELINE NO WAIT STATE BUS SRAM |
| IS61NLP12832-5B | PIPELINE NO WAIT STATE BUS SRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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