tSU:STO tDH
參數(shù)資料
型號(hào)： ISL98002CRZ-140
廠商： Intersil
文件頁數(shù)： 25/28頁
文件大?。?/td> 0K
描述： IC VID DIGITIZER 3CHN AFE 72-QFN
標(biāo)準(zhǔn)包裝： 840
位數(shù)： 8
通道數(shù)： 3
功率（瓦特）： 525mW
電壓 - 電源，模擬： 3 V ~ 3.6 V
電壓 - 電源，數(shù)字： 3 V ~ 3.6 V
封裝/外殼： 72-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 72-QFN（10x10）
包裝： 托盤
6
FN6535.1
December 7, 2009
tSU:STO
tDH
tHIGH
tSU:STA
tHD:STA
tHD:DAT
tSU:DAT
SCL
SDA IN
SDA OUT
tF
tLOW
tBUF
tAA
tR
FIGURE 1. 2-WIRE INTERFACE TIMING
FIGURE 2. DATA OUTPUT SETUP AND HOLD TIMING
Pixel Data
DATACLK
t
HOLD
t
SETUP
DATACLK
Programmable
Width and Polarity
Analog
Video In
P
1
P
2
P
3
P
4
P
5
P
6
P
7
P
8
P
0
P
9
D
0
R
P/GP/BP[7:0]
HS
OUT
8 DATACLK Pipeline Latency
R
S/GS/BS[7:0]
P
10
P
11
P
12
D
1
D
2
D
3
HSYNC
IN
The HSYNC edge (programmable leading or trailing) that the DPLL is locked to.
The sampling phase setting determines its relative position to the rest of the AFE’s output signals
DATACLK
t
HSYNCin-to-HSout = 7.5ns + (PHASE/64 +8.5)*tPIXEL
FIGURE 3. OUTPUT MODE
ISL98002
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PDF描述
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