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參數(shù)資料
| 型號： | ISP1181ABS |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | INDUCTOR 1.0NH +-.3NH FIXED SMD |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQCC48 |
| 封裝： | 7 X 7 MM, 0.85 MM HEIGHT, PLASTIC, MO-220, SOT-619-2, HVQFN-48 |
| 文件頁數(shù)： | 30/70頁 |
| 文件大?。?/td> | 341K |
| 代理商： | ISP1181ABS |
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Philips Semiconductors
ISP1181A
Full-speed USB peripheral controller
Product data
Rev. 05 — 08 December 2004
30 of 70
9397 750 13959
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
12.1.6
Write/Read DMA Configuration
This command defines the DMA configuration of ISP1181A and enables/disables
DMA transfers. The command accesses the DMA Configuration Register, which
consists of 2 bytes. The bit allocation is given in
Table 24
. A bus reset will clear bit
DMAEN (DMA disabled), all other bits remain unchanged.
Code (Hex): F0/F1 —
write/read DMA Configuration
Transaction —
write/read 2 bytes
[1]
Unchanged by a bus reset.
Bit
Symbol
Reset
Access
7
6
5
4
3
2
1
0
reserved
IEPSOF
0
R/W
IESOF
0
R/W
IEEOT
0
R/W
IESUSP
0
R/W
IERESM
0
R/W
IERST
0
R/W
0
0
R/W
R/W
Table 23:
Bit
31 to 24
23 to 10
9
8
7, 6
5
Interrupt Enable Register: bit description
Symbol
Description
-
reserved; must write logic 0
IEP14 to IEP1
A logic 1 enables interrupts from the indicated endpoint.
IEP0IN
A logic 1 enables interrupts from the control IN endpoint.
IEP0OUT
A logic 1 enables interrupts from the control OUT endpoint.
-
reserved
IEPSOF
A logic 1 enables 1 ms interrupts upon detection of Pseudo
SOF.
IESOF
A logic 1 enables interrupt upon SOF detection.
IEEOT
A logic 1 enables interrupt upon EOT detection.
IESUSP
A logic 1 enables interrupt upon detection of ‘suspend’ state.
IERESM
A logic 1 enables interrupt upon detection of a ‘resume’ state.
IERST
A logic 1 enables interrupt upon detection of a bus reset.
4
3
2
1
0
Table 24:
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
DMA Configuration Register: bit allocation
15
14
CNTREN
SHORTP
0
[1]
0
[1]
R/W
R/W
7
6
13
12
11
10
9
8
reserved
0
[1]
R/W
5
0
[1]
R/W
4
0
[1]
R/W
3
DMAEN
0
R/W
0
[1]
R/W
2
0
[1]
R/W
1
0
[1]
R/W
0
EPDIX[3:0]
0
[1]
R/W
reserved
0
R/W
BURSTL[1:0]
0
[1]
R/W
0
[1]
R/W
0
[1]
R/W
0
[1]
R/W
0
[1]
R/W
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ISP1181A | Full-speed Universal Serial Bus peripheral controller |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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