Specifications ispLSI 2032E 8 Internal Timing Parameters1 t
參數(shù)資料
型號： ISPLSI 2032E-200LT48
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 13/14頁
文件大小： 0K
描述： IC PLD ISP 32I/O 3.5NS 48TQFP
標(biāo)準(zhǔn)包裝： 250
系列： ispLSI® 2000E
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1)： 3.5ns
電壓電源 - 內(nèi)部： 4.75 V ~ 5.25 V
邏輯元件/邏輯塊數(shù)目： 8
宏單元數(shù)： 32
門數(shù)： 1000
輸入/輸出數(shù)： 32
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-TQFP（7x7）
包裝： 托盤
其它名稱： ISPLSI2032E-200LT48
Specifications ispLSI 2032E
8
Internal Timing Parameters1
tio
1. Internal Timing Parameters are not tested and are for reference only.
2. Refer to Timing Model in this data sheet for further details.
3. The XOR adjacent path can only be used by hard macros.
Table 2-0036B/2032E
Inputs
UNITS
-135
MIN.
-110
MIN.
MAX.
DESCRIPTION
#
2
PARAMETER
20 Input Buffer Delay
–
1.7
ns
tdin
21 Dedicated Input Delay
–
3.4
ns
tgrp
22 GRP Delay
–
1.7
ns
GLB
t1ptxor
25 1 Product Term/XOR Path Delay
–
6.2
ns
t20ptxor
26 20 Product Term/XOR Path Delay
–
6.8
ns
txoradj
27 XOR Adjacent Path Delay
–
7.5
ns
tgbp
28 GLB Register Bypass Delay
–
0.1
ns
tgsu
29 GLB Register Setup Time before Clock
–
0.5
–
ns
tgh
30 GLB Register Hold Time after Clock
–
4.0
–
ns
tgco
31 GLB Register Clock to Output Delay
–
0.6
ns
3
tgro
32 GLB Register Reset to Output Delay
–
1.8
ns
tptre
33 GLB Product Term Reset to Register Delay
–
5.9
ns
tptoe
34 GLB Product Term Output Enable to I/O Cell Delay
–
7.1
ns
tptck
35 GLB Product Term Clock Delay
4.0
7.0
ns
ORP
tob
38 Output Buffer Delay
–
1.2
ns
1.1
2.4
GRP
1.3
t4ptbpc
23 4 Product Term Bypass Path Delay (Combinatorial)
–
4.9
ns
t4ptbpr
24 4 Product Term Bypass Path Delay (Registered)
–
4.8
ns
5.0
5.1
5.6
0.0
3.6
0.3
3.0
0.7
1.1
4.4
6.4
2.9
5.2
torp
36 ORP Delay
–
1.5
ns
torpbp
37 ORP Bypass Delay
–
0.5
ns
1.3
0.3
Outputs
1.2
tsl
39 Output Slew Limited Delay Adder
–
10.0
ns
10.0
toen
40 I/O Cell OE to Output Enabled
–
4.0
ns
todis
41 I/O Cell OE to Output Disabled
–
4.0
ns
3.2
tgoe
42 Global Output Enable
–
3.0
ns
2.8
tgy0
43 Clock Delay, Y0 to Global GLB Clock Line (Ref. clock)
2.3
3.2
ns
tgy1/2
44 Clock Delay, Y1 or Y2 to Global GLB Clock Line
2.3
3.2
ns
Clocks
2.3
tgr
45 Global Reset to GLB
––
9.0
ns
Global Reset
6.4
相關(guān)PDF資料
PDF描述
EEC05DRXH CONN EDGECARD 10POS DIP .100 SLD
VE-B4Y-CY-B1 CONVERTER MOD DC/DC 3.3V 33W
VE-B4Y-CX-B1 CONVERTER MOD DC/DC 3.3V 49.5W
TAJA334M035SNJ CAP TANT 0.33UF 35V 20% 1206
VI-JTP-CW-B1 CONVERTER MOD DC/DC 13.8V 100W
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
ispLSI2032E-200LT48 功能描述:CPLD - 復(fù)雜可編程邏輯器件 USE ispMACH 4000V RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
ISPLSI2032E-225LJ44 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
ISPLSI2032E-225LT44 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
ISPLSI2032E-225LT48 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
ISPLSI2032LV60LJ 制造商:LATTICE 功能描述:New
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