Specifications ispLSI 5384VE 16 ispLSI 5384VE Timing Parameters (continued) Timing Table/5384VE Timing v.2.0 Tioi Input Adders Routing Adders <" />
參數(shù)資料
型號: ISPLSI 5384VE-165LF256
廠商: Lattice Semiconductor Corporation
文件頁數(shù): 8/22頁
文件大?。?/td> 0K
描述: IC PLD ISP 192I/O 6NS 256FPBGA
標(biāo)準(zhǔn)包裝: 90
系列: ispLSI® 5000VE
可編程類型: 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1): 6.0ns
電壓電源 - 內(nèi)部: 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目: 12
宏單元數(shù): 384
門數(shù): 18000
輸入/輸出數(shù): 192
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 256-BGA
供應(yīng)商設(shè)備封裝: 256-FPBGA(17x17)
包裝: 托盤
其它名稱: ISPLSI5384VE-165LF256
Specifications ispLSI 5384VE
16
ispLSI 5384VE Timing Parameters (continued)
Timing Table/5384VE
Timing v.2.0
Tioi Input Adders
Routing Adders
Tioo Output Adders1
Tbla Additional Block Loading Adders
UNITS
ADDER
-100
-80
BASE PARAMETER
ADDER TYPE
clk1
clk3
1.7
ns
clk2
1.7
ns
1
0.1
ns
2
0.2
ns
3
0.3
ns
tgclk_in
troute
1.7
0.1
0.2
0.3
-125
-165
1.7
0.1
0.2
0.3
1.4
tlp
1.5
ns
troute
1.5
1.0
1.4
1.7
1.4
0.1
0.2
4
0.4
ns
troute
0.4
0.3
5
0.5
ns
troute
0.5
0.4
6
0.6
ns
troute
0.6
0.4
7
0.7
ns
troute
0.7
0.5
8
0.8
ns
troute
0.8
0.6
9
0.9
ns
troute
0.9
0.6
10
1.0
ns
troute
1.0
0.7
11
1.1
ns
troute
1.1
0.8
1Timing for open drain configurations is the same as non-open drain configurations.
Note: Internal Timing Parameters are not tested and are for reference only. Refer to Timing Model in this data sheet for
details.
Slow Slew I/O
LVCMOS25_out
0.5
ns
tbuf, ten, tdis
tbuf, ten
4.0
0.5
4.0
0.5
LVCMOS33_out
0.0
ns
tbuf, ten, tdis
0.0
LVTTL_out
0.0
ns
tbuf, ten, tdis
0.0
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ISPLSI5384VE-80LF256I 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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