Specifications ispLSI 5512VE 9 Figure 6. Boundary Scan Register Circuit for I/O Pins Figure 7. Boundary Scan Register Circuit for Input-Only Pi" />
參數(shù)資料
型號: ISPLSI 5512VE-100LB388
廠商: Lattice Semiconductor Corporation
文件頁數(shù): 25/25頁
文件大?。?/td> 0K
描述: IC PLD ISP 256I/O 10NS 388BGA
標(biāo)準(zhǔn)包裝: 24
系列: ispLSI® 5000VE
可編程類型: 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1): 10.0ns
電壓電源 - 內(nèi)部: 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目: 16
宏單元數(shù): 512
門數(shù): 24000
輸入/輸出數(shù): 256
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 388-BBGA
供應(yīng)商設(shè)備封裝: 388-BGA(35x35)
包裝: 托盤
其它名稱: ISPLSI5512VE-100LB388
Specifications ispLSI 5512VE
9
Figure 6. Boundary Scan Register Circuit for I/O Pins
Figure 7. Boundary Scan Register Circuit for Input-Only Pins
Normal
Function
OE
EXTEST
Update DR
SCANOUT
(to next cell)
Clock DR
SCANIN
(from previous
cell)
Shift DR
Normal
Function
TOE
DQ
D
1
0
1
0
1
0
Q
DQ
I/O Pin
Reset
BSCAN
Registers
BSCAN
Latches
HIGHZ
0
PROG_MODE
EXTEST
1
0
1
SCANOUT
(to next cell)
Clock DR
SCANIN
(from previous
cell)
Shift DR
DQ
Input Pin
0
1
相關(guān)PDF資料
PDF描述
HCM08DRTH-S13 CONN EDGECARD 16POS .156 EXTEND
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參數(shù)描述
ISPLSI5512VE-100LB388 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
ISPLSI5512VE-100LB388I 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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ISPLSI5512VE-100LF256-80I 制造商:Lattice Semiconductor Corporation 功能描述:
ISPLSI5512VE-100LF256I 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100