Specifications ispLSI 5512VE 18 ispLSI 5512VE Timing Model tBLA t
參數(shù)資料
型號： ISPLSI 5512VE-155LB388
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 10/25頁
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描述： IC PLD ISP 256I/O 6.5NS 388BGA
標(biāo)準(zhǔn)包裝： 24
系列： ispLSI® 5000VE
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1)： 6.5ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目： 16
宏單元數(shù)： 512
門數(shù)： 24000
輸入/輸出數(shù)： 256
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 388-BBGA
供應(yīng)商設(shè)備封裝： 388-BGA（35x35）
包裝： 托盤
其它名稱： ISPLSI5512VE-155LB388
Specifications ispLSI 5512VE
18
ispLSI 5512VE Timing Model
tBLA
tLP
tIOI
tBSR
tPTSR
tGPTOE
tPTOE
tPDi
tGOE
tRST
tIN
tINREG
tROUTE
tPDb
tFBK
tBUF
tIOO
tEN
tDIS
tPTSA
tPTCLK
tBCLK
tGCLK_IN
IN
Q
OE
From Feedback
In/Out
Delays
In/Out
Delays
Routing/
GLB Delays
Register/
Latch Delays
Control
Delays
Feedback
OUT
DATA
MC Reg
CE
S/R
CLK
RST
Note: Italicized parameters are delay adders above and beyond default conditions (i.e. GRP load of one GLB, CLK0, high-speed AND Array
and VCC I/O option).
5000VE Timing Model
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PDF描述
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參數(shù)描述
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ISPLSI5512VE-155LF256-125I 制造商:Lattice Semiconductor Corporation 功能描述:COMPLEX-EEPLD, 512-CELL, 8NS PROP DELAY, 256 Pin, Plastic, BGA
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