參數(shù)資料
型號： ISPLSI2064-80LJ
英文描述： IC-SM-ISP-CMOS PLD
中文描述： 集成電路釤的互聯(lián)網(wǎng)服務(wù)提供商的CMOS可編程邏輯器件
文件頁數(shù)： 6/12頁
文件大?。?/td> 120K
代理商： ISPLSI2064-80LJ
Specifications
ispLSI 1048
6
USEispLS 1048EAFORNEW
COMMERCAL&INDUSTRAL
46
ORP Bypass Delay
DESGNS
Internal Timing Parameters
1
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
–
–
8.1
0.9
–
–
–
–
–
–
–
–
–
–
–
–
–
–
2.0
8.0
–
–
–
–
4.6
–
–
4.0
5.3
–
–
3.9
4.6
8.0
3.3
4.0
5.3
6.7
8.0
21.3
8.6
9.3
10.0
12.7
1.3
–
–
3.3
3.3
13.3
11.9
9.9
4.7
2.0
MIN. MAX.
DESCRIPTION
PARAMETER
UNITS
-50
Inputs
t
iobp
t
iolat
t
iosu
t
ioh
t
ioco
t
ior
t
din
GRP
t
grp1
t
grp4
t
grp8
t
grp12
t
grp16
t
grp48
GLB
t
4ptbp
t
1ptxor
t
20ptxor
t
xoradj
t
gbp
t
gsu
t
gh
t
gco
t
gr
t
ptre
t
ptoe
t
ptck
ORP
t
orp
t
orpbp
#
2
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
I/O Register Bypass
I/O Latch Delay
I/O Register Setup Time before Clock
I/O Register Hold Time after Clock
I/O Register Clock to Out Delay
I/O Register Reset to Out Delay
Dedicated Input Delay
GRP Delay, 1 GLB Load
GRP Delay, 4 GLB Loads
GRP Delay, 8 GLB Loads
GRP Delay, 12 GLB Loads
GRP Delay, 16 GLB Loads
GRP Delay, 48 GLB Loads
4 Product Term Bypass Path Delay
1 Product Term/XOR Path Delay
20 Product Term/XOR Path Delay
XOR Adjacent Path Delay
3
GLB Register Bypass Delay
GLB Register Setup Time before Clock
GLB Register Hold Time after Clock
GLB Register Clock to Output Delay
GLB Register Reset to Output Delay
GLB Product Term Reset to Register Delay
GLB Product Term Output Enable to I/O Cell Delay
GLB Product Term Clock Delay
ORP Delay
1. Internal Timing Parameters are not tested and are for reference only.
2. Refer to Timing Model in this data sheet for further details.
3. The XOR adjacent path can only be used by hard macros.
–
–
6.0
0.5
–
–
–
–
–
–
–
–
–
–
–
–
–
–
1.5
6.0
–
–
–
–
3.5
–
–
3.0
4.0
–
–
3.0
3.5
6.0
2.5
3.0
4.0
5.0
6.0
16.0
6.5
7.0
7.5
9.5
1.0
–
–
2.5
2.5
10.0
9.0
7.5
3.5
1.5
MIN. MAX.
-70
–
–
5.3
1.5
–
–
–
–
–
–
–
–
–
–
–
–
–
–
0.8
5.0
–
–
–
–
2.9
–
–
2.5
3.3
–
–
2.5
2.9
5.0
2.1
2.5
3.3
4.2
5.0
13.3
5.4
6.5
7.6
8.4
0.8
–
–
2.1
2.1
8.3
8.8
6.3
3.2
1.3
MIN. MAX.
-80
Table 2- 0036A-48/80,70,50.eps
相關(guān)PDF資料
PDF描述
ISPLSI2064A-100LJ84 Electrically-Erasable Complex PLD
ISPLSI2064A-100LT100
ISPLSI2064A-125LJ84 Electrically-Erasable Complex PLD
ISPLSI2064A-125LT100
ISPLSI2064A-80LJ84 Electrically-Erasable Complex PLD
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參數(shù)描述
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ISPLSI-2064-80LTI 制造商:Rochester Electronics LLC 功能描述: 制造商:Lattice Semiconductor Corporation 功能描述:
ISPLSI2064-80LTI 制造商:Rochester Electronics LLC 功能描述:- Bulk
ispLSI2064A-100LJ84 功能描述:CPLD - 復(fù)雜可編程邏輯器件 USE ispMACH 4000V RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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