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參數(shù)資料
| 型號： | ISPPAC-CLK5312S-01TN48C |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁數(shù)： | 7/56頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK PROGRAM BUFFER 48TQFP |
| 標(biāo)準包裝： | 250 |
| 系列： | ispClock™ |
| 類型： | 時鐘發(fā)生器，扇出配送，零延遲緩沖器 |
| PLL： | 帶旁路 |
| 輸入： | HSTL，LVCMOS，LVDS，LVPECL，LVTTL，SSTL |
| 輸出： | eHSTL，HSTL，LVCMOS，LVTTL，SSTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:12 |
| 差分 - 輸入:輸出： | 是/無 |
| 頻率 - 最大： | 267MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-LQFP |
| 供應(yīng)商設(shè)備封裝： | 48-TQFP（7x7） |
| 包裝： | 托盤 |
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Lattice Semiconductor
ispClock5300S Family Data Sheet
15
Timing Diagrams
Figure 8. Erase (User Erase or Erase All) Timing Diagram
Figure 9. Programming Timing Diagram
Figure 10. Verify Timing Diagram
Figure 11. Discharge Timing Diagram
VIH
VIL
VIH
VIL
Update-IR
Run-Test/Idle (Erase)
Select-DR Scan
Clock
to
Shift-IR
state
and
shift
in
the
Discharge
Instruction,
then
clock
to
the
Run-T
est/Idle
state
Run-Test/Idle (Discharge)
TMS
TCK
State
t
H
t
H
t
H
t
H
t
H
t
H
t
SU1
t
SU1
t
SU1
t
SU1
t
SU1
t
SU1
t
CKH
t
CKH
t
CKH
t
CKH
t
CKH
t
CKL
t
BEW
t
CKL
TMS
TCK
State
VIH
VIL
VIH
VI L
Update-IR
Run-Test/Idle (Program)
Select-DR Scan
Clock
to
Shift-IR
state
and
shift
in
the
next
Instruction,
which
will
stop
the
discharge
process
Update-IR
t
SU1
t
SU1
t
SU1
t
SU1
t
SU1
t
H
t
H
t
H
t
H
t
H
t
CKL
t
PWP
t
CKH
t
CKH
t
CKH
t
CKH
t
CKL
TMS
TCK
State
VIH
VIL
VIH
VIL
Update-IR
Run-Test/Idle (Program)
Select-DR Scan
Clock
to
Shift-IR
state
and
shift
in
the
next
Instruction
Update-IR
t
H
t
H
t
H
t
H
t
H
t
CKH
t
CKH
t
CKH
t
CKL
t
PWV
t
CKH
t
CKL
t
SU1
t
SU1
t
SU1
t
SU1
t
SU1
TMS
TCK
State
VIH
VIL
VIH
VIL
Update-IR
Run-Test/Idle (Erase or Program)
Select-DR Scan
Clock
to
Shift-IR
state
and
shift
in
the
Verify
Instruction,
then
clock
to
the
Run-Test/Idle
state
Run-Test/Idle (Verify)
Specified by the Data Sheet
Actual
t
H
t
H
t
H
t
H
t
H
t
H
t
SU1
t
CKH
t
HVDIS (Actual)
t
CKH
t
CKH
t
CKH
t
CKL
t
PWP or tBEW
t
PWV
t
CKH
t
CKL
t
PWV
t
SU1
t
SU1
t
SU1
t
SU1
t
SU1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VI-2TN-MY-F1 | CONVERTER MOD DC/DC 18.5V 50W |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ISPPACCLK5312S-01TN48C | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:In-System Programmable, Zero-Delay, Universal Fan-Out Buffer, Single-Ended |
| ispPAC-CLK5312S-01TN48I | 功能描述:時鐘驅(qū)動器及分配 ISP 0 Delay Unv Fan- Out Buf-Sngl End I RoHS:否 制造商:Micrel 乘法/除法因子:1:4 輸出類型:Differential 最大輸出頻率:4.2 GHz 電源電壓-最大: 電源電壓-最小:5 V 最大工作溫度:+ 85 C 封裝 / 箱體:SOIC-8 封裝:Reel |
| ISPPACCLK5312S-01TN48I | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:In-System Programmable, Zero-Delay, Universal Fan-Out Buffer, Single-Ended |
| ISPPACCLK5312S-01TN64C | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:In-System Programmable, Zero-Delay, Universal Fan-Out Buffer, Single-Ended |
| ISPPACCLK5312S-01TN64I | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:In-System Programmable, Zero-Delay, Universal Fan-Out Buffer, Single-Ended |
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