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參數(shù)資料
| 型號： | IW4027BN |
| 廠商： | INTEGRAL JOINT STOCK COMPANY |
| 英文描述： | Dual JK Flip-Flop |
| 中文描述： | 雙JK觸發(fā)器 |
| 文件頁數(shù)： | 6/6頁 |
| 文件大小： | 48K |
| 代理商： | IW4027BN |
IW4027B
6
INTEGRAL
CHIP PAD DIAGRAM IZ4027B
Pad size 0.100 x 0.100 mm
(Pad size is given as per passivation layer)
Thickness of chip 0.46
±
0.02 mm
PAD LOCATION
Pad No
01
02
03
04
05
06
07
08
09
10
11
12
13
14
15
16
Symbol
Q2
Q2
Clock 2
Reset 2
K2
J2
Set 2
GND
Set 1
J1
K1
Reset 1
Clock 1
Q1
Q1
Vcc
X
Y
0.116
0.111
0.474
0.6555
0.8335
1.124
1.124
1.1245
1.124
1.124
0.8335
0.6555
0.474
0.111
0.116
0.116
0.4215
0.126
0.1755
0.1755
0.174
0.1235
0.4065
0.6855
0.9335
1.2165
1.166
1.1645
1.1645
1.214
0.9185
0.7365
1.34 0.03
1
±
02
06
14
10
13
03
12
04
11
05
15
09
16
08
01
07
Chip marking
402720
(x=0.093, y=0.5825)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IW4028 | BCD-to-Decimal Decoder High-Voltage Silicon-Gate CMOS |
| IW4028B | BCD-to-Decimal Decoder High-Voltage Silicon-Gate CMOS |
| IW4028BD | BCD-to-Decimal Decoder High-Voltage Silicon-Gate CMOS |
| IW4028BN | BCD-to-Decimal Decoder High-Voltage Silicon-Gate CMOS |
| IW4029 | Presettable Up/Down Counter High-Voltage Silicon-Gate CMOS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| IW4028 | 制造商:INTEGRAL 制造商全稱:INTEGRAL 功能描述:BCD-to-Decimal Decoder High-Voltage Silicon-Gate CMOS |
| IW4028B | 制造商:IKSEMICON 制造商全稱:IK Semicon Co., Ltd 功能描述:BCD-to-Decimal Decoder High-Voltage Silicon-Gate CMOS |
| IW4028BD | 制造商:IKSEMICON 制造商全稱:IK Semicon Co., Ltd 功能描述:BCD-to-Decimal Decoder High-Voltage Silicon-Gate CMOS |
| IW4028BN | 制造商:IKSEMICON 制造商全稱:IK Semicon Co., Ltd 功能描述:BCD-to-Decimal Decoder High-Voltage Silicon-Gate CMOS |
| IW4029 | 制造商:INTEGRAL 制造商全稱:INTEGRAL 功能描述:Presettable Up/Down Counter High-Voltage Silicon-Gate CMOS |
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