VT 3mA Mode 620 mV" />
參數(shù)資料
型號(hào)： KAD5512HP-17Q72
廠商： Intersil
文件頁(yè)數(shù)： 32/34頁(yè)
文件大?。?/td> 0K
描述： IC ADC 12BIT 170MSPS SGL 72-QFN
產(chǎn)品培訓(xùn)模塊： High-Speed Analog-to-Digital Converters
標(biāo)準(zhǔn)包裝： 1
系列： FemtoCharge™
位數(shù)： 12
采樣率（每秒）： 170M
數(shù)據(jù)接口： 串行，SPI?
轉(zhuǎn)換器數(shù)目： 1
功率耗散（最大）： 406mW
電壓電源： 單電源
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 72-VFQFN 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝： 72-QFN（10x10）
包裝： 托盤(pán)
輸入數(shù)目和類(lèi)型： 1 個(gè)差分，單極
7
FN6808.3
October 1, 2009
LVDS OUTPUTS
Differential Output Voltage
VT
3mA Mode
620
mVP-P
Output Offset Voltage
VOS
3mA Mode
950
965
980
mV
Output Rise Time
tR
500
ps
Output Fall Time
tF
500
ps
CMOS OUTPUTS
Voltage Output High
VOH
IOH = -500A
OVDD - 0.3
OVDD - 0.1
V
Voltage Output Low
VOL
IOL = 1mA
0.1
0.3
V
Output Rise Time
tR
1.8
ns
Output Fall Time
tF
1.4
ns
Digital Specifications (Continued)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
Timing Diagrams
FIGURE 1A. DDR
FIGURE 1B. SDR
FIGURE 1. LVDS TIMING DIAGRAMS (See “Digital Outputs” on page 20
FIGURE 2A. DDR
FIGURE 2B. SDR
FIGURE 2. CMOS TIMING DIAGRAM (See “Digital Outputs” on page 20
LATENCY = L CYCLES
tDC
tPD
tA
SAMPLE N
tCPD
INP
INN
CLKN
CLKP
CLKOUTN
CLKOUTP
ODD BITS
N-L
ODD BITS
EVEN BITS
N-L + 1
N-L + 2
EVEN BITS
D[10/8/6/4/2/0]P
D[10/8/6/4/2/0]N
N
LATENCY = L CYCLES
tDC
tPD
tA
SAMPLE N
tCPD
INP
INN
CLKN
CLKP
CLKOUTN
CLKOUTP
DATA
N-L + 1
D[11/0]P
D[11/0]N
N
DATA
N-L
SAMPLE N
tDC
tPD
tA
INP
INN
CLKN
CLKOUT
CLKP
D[10/8/6/4/2/0]
LATENCY = L CYCLES
ODD BITS
N-L
ODD BITS
EVEN BITS
N-L + 1
N-L + 2
EVEN BITS
N
tCPD
SAMPLE N
INP
INN
CLKN
CLKOUT
CLKP
tCPD
tA
D[11/0]
tDC
tPD
DATA
N-L
DATA
N-L + 1
N
LATENCY = L CYCLES
KAD5512HP
相關(guān)PDF資料
PDF描述
KAD5512P-17Q72 IC ADC 12BIT 170MSPS SGL 72-QFN
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參數(shù)描述
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KAD5512P 制造商:INTERSIL 制造商全稱(chēng):Intersil Corporation 功能描述:Low Power 12-Bit, 250/210/170/125MSPS ADC
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