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參數(shù)資料
| 型號： | KMPC8247CZQTIEA |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 15/61頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU PWRQUICC II 516-PBGA |
| 標準包裝： | 2 |
| 系列： | MPC82xx |
| 處理器類型： | 32-位 MPC82xx PowerQUICC II |
| 速度： | 400MHz |
| 電壓： | 1.8V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 516-BBGA |
| 供應商設備封裝： | 516-FPBGA（27x27） |
| 包裝： | 托盤 |
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MPC8272 PowerQUICC II Family Hardware Specifications, Rev. 3
22
Freescale Semiconductor
AC Electrical Characteristics
This figure shows PIO and timer signals.
Figure 8. PIO and Timer Signal Diagram
6.2
SIU AC Characteristics
This table lists SIU input characteristics.
NOTE: CLKIN Jitter and Duty Cycle
The CLKIN input to the SoC should not exceed +/– 150 psec of jitter
(peak-to-peak). This represents total input jitter—the combination of short
term (peak-to-peak) and long term (cumulative). The duty cycle of CLKIN
should not exceed the ratio of 40:60.
NOTE: Spread Spectrum Clocking
Spread spectrum clocking is allowed with 1% input frequency down-spread
at maximum 60 KHz modulation rate regardless of input frequency.
NOTE: PCI AC Timing
The SoC meets the timing requirements of PCI Specification Revision 2.2.
See Section 7, “Clock Configuration Modes,” and “Note: Tval (Output
Hold)” to determine if a specific clock configuration is compliant.
Sys clk
PIO/IDMA/TIMER[TGATE assertion] input signals
IDMA output signals
sp22
sp23
sp42/sp43
TIMER(sp42/43)/ PIO(sp42a/sp43a)
sp42a/sp43a
output signals
sp42/sp43
TIMER input signal [TGATE deassertion]
sp22
sp23
Note: TGATE is asserted on the rising edge of the clock; it is deasserted on the falling edge.
(See note)
相關PDF資料 |
PDF描述 |
|---|---|
| KMPC8247CVRTIEA | IC MPU PWRQUICC II 516-PBGA |
| KMPC8245TZU333D | IC MPU 32BIT 333MHZ 352-TBGA |
| KMPC8245TVV350D | IC MPU 32BIT 350MHZ 352-TBGA |
| KMPC8245TVV333D | IC MPU 32BIT 333MHZ 352-TBGA |
| KMPC8245LZU333D | IC MPU 32BIT 333MHZ 352-TBGA |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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