參數(shù)資料
型號: KMPC8377CVRALG
廠商: Freescale Semiconductor
文件頁數(shù): 33/127頁
文件大?。?/td> 0K
描述: IC MPU POWERQUICC II 689-PBGA
標(biāo)準(zhǔn)包裝: 2
系列: MPC83xx
處理器類型: 32-位 MPC83xx PowerQUICC II Pro
速度: 667MHz
電壓: 1V
安裝類型: 表面貼裝
封裝/外殼: 689-BBGA 裸露焊盤
供應(yīng)商設(shè)備封裝: 689-TEPBGA II(31x31)
包裝: 托盤
MPC8377E PowerQUICC II Pro Processor Hardware Specifications, Rev. 8
Freescale Semiconductor
13
4
Clock Input Timing
This section provides the clock input DC and AC electrical characteristics for the chip. Note that the
PCI_CLK/PCI_SYNC_IN signal or CLKIN signal is used as the PCI input clock depending on whether
the device is configured as a host or agent device. CLKIN is used when the device is in host mode.
PCI I/O
Load =
30 pf
33 MHz,
32-bit
0.04
W
66 MHz,
32-bit
0.07
W
Local Bus
I/O
Load =
25 pf
167 MHz,
32-bit
0.09
0.17
0.29
W
133 MHz,
32-bit
0.07
0.14
0.24
W
83 MHz,
32-bit
0.05
0.09
0.15
W
66 MHz,
32-bit
0.04
0.07
0.13
W
50 MHz,
32-bit
0.03
0.06
0.1
W
eTSEC I/O
Load =
25 pf
MII or RMII
0.02
W
Multiply by
number of
interfaces used.
RGMII or
RTBI
0.05
W
USB
(60MHz
Clock)
12 Mbps
0.01
W
480 Mbps
0.2
W
SerDes
per lane
0.029
W
Other I/O
0.01
W
Note: The values given are for typical, and not worst case, switching.
Table 6. Typical I/O Power Dissipation (continued)
Interface
Parameter
GVDD
(1.8 V)
GVDD/LBVDD
(2.5 V)
OVDD
(3.3 V)
LVDD
(3.3 V)
LVDD
(2.5 V)
L[1,2]_
nVDD
(1.0 V)
Unit
Comments
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PDF描述
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參數(shù)描述
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