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參數(shù)資料
| 型號： | KMPC870CVR66 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 55/84頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU POWERQUICC 66MHZ 256PBGA |
| 標(biāo)準(zhǔn)包裝： | 2 |
| 系列： | MPC8xx |
| 處理器類型： | 32-位 MPC8xx PowerQUICC |
| 速度： | 66MHz |
| 電壓： | 3.3V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-BGA |
| 供應(yīng)商設(shè)備封裝： | 256-PBGA（23x23） |
| 包裝： | 托盤 |
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MPC875/MPC870 PowerQUICC Hardware Specifications, Rev. 4
Freescale Semiconductor
59
CPM Electrical Characteristics
Figure 55. HDLC Bus Timing Diagram
13.7
Ethernet Electrical Specifications
Table 24. Ethernet Timing
Num
Characteristic
All Frequencies
Unit
Min
Max
120
CLSN width high
40
—
ns
121
RCLK3 rise/fall time
—
15
ns
122
RCLK3 width low
40
—
ns
123
RCLK3 clock period1
80
120
ns
124
RXD3 setup time
20
—
ns
125
RXD3 hold time
5—
ns
126
RENA active delay (from RCLK3 rising edge of the last data bit)
10
—
ns
127
RENA width low
100
—
ns
128
TCLK3 rise/fall time
—
15
ns
129
TCLK3 width low
40
—
ns
130
TCLK3 clock period1
99
101
ns
131
TXD3 active delay (from TCLK3 rising edge)
—
50
ns
132
TXD3 inactive delay (from TCLK3 rising edge)
6.5
50
ns
133
TENA active delay (from TCLK3 rising edge)
10
50
ns
134
TENA inactive delay (from TCLK3 rising edge)
10
50
ns
TCLK3
CTS3
(Echo Input)
102
100
104
TxD3
(Output)
102
101
RTS3
(Output)
103
104
107
105
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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