參數(shù)資料
型號： KMPC870ZT66
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： Hardware Specifications
中文描述： 硬件規(guī)格
文件頁數(shù)： 63/92頁
文件大?。?/td> 1499K
代理商： KMPC870ZT66
MPC885/MPC880 Hardware Specifications, Rev. 3
63
Freescale Semiconductor
CPM Electrical Characteristics
Figure 63. Ethernet Transmit Timing Diagram
12.9 SMC Transparent AC Electrical Specifications
Table 25
provides the SMC transparent timings as shown in
Figure 64
.
Table 25. SMC Transparent Timing
Num
Characteristic
All Frequencies
Unit
Min
Max
150
SMCLK clock period
1
1
SyncCLK must be at least twice as fast as SMCLK.
100
—
ns
151
SMCLK width low
50
—
ns
151A
SMCLK width high
50
—
ns
152
SMCLK rise/fall time
—
15
ns
153
SMTXD active delay (from SMCLK falling edge)
10
50
ns
154
SMRXD/SMSYNC setup time
20
—
ns
155
RXD1/SMSYNC hold time
5
—
ns
TCLK1
128
TxD1
(Output)
128
TENA(RTS1)
(Input)
NOTES:
1.
2.
Transmit clock invert (TCI) bit in GSMR is set.
If RENA is negated before TENA or RENA is not asserted at all during transmit, then the
CSL bit is set in the buffer descriptor at the end of the frame transmission.
RENA(CD1)
(Input)
(NOTE 2)
133
134
132
131
121
129
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PDF描述
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參數(shù)描述
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