參數(shù)資料
型號: KMPC875VR133
廠商: Freescale Semiconductor
文件頁數(shù): 58/84頁
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描述: IC MPU POWERQUICC 133MHZ 256PBGA
標(biāo)準(zhǔn)包裝: 2
系列: MPC8xx
處理器類型: 32-位 MPC8xx PowerQUICC
速度: 133MHz
電壓: 3.3V
安裝類型: 表面貼裝
封裝/外殼: 256-BGA
供應(yīng)商設(shè)備封裝: 256-PBGA(23x23)
包裝: 托盤
MPC875/MPC870 PowerQUICC Hardware Specifications, Rev. 4
Freescale Semiconductor
61
CPM Electrical Characteristics
Figure 58. Ethernet Transmit Timing Diagram
13.8
SMC Transparent AC Electrical Specifications
Table 25 provides the SMC transparent timings as shown in Figure 59.
Table 25. SMC Transparent Timing
Num
Characteristic
All Frequencies
Unit
Min
Max
150
SMCLK clock period1
1
SYNCCLK must be at least twice as fast as SMCLK.
100
ns
151
SMCLK width low
50
ns
151A
SMCLK width high
50
ns
152
SMCLK rise/fall time
15
ns
153
SMTXD active delay (from SMCLK falling edge)
10
50
ns
154
SMRXD/SMSYNC setup time
20
ns
155
RXD1/SMSYNC hold time
5
ns
TCLK3
128
TxD3
(Output)
128
TENA(RTS3)
(Input)
Notes:
Transmit clock invert (TCI) bit in GSMR is set.
If RENA is negated before TENA or RENA is not asserted at all during transmit, then the
CSL bit is set in the buffer descriptor at the end of the frame transmission.
1.
2.
RENA(CD3)
(Input)
133
134
132
131
121
129
(Note 2)
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