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參數(shù)資料
| 型號： | LC5256MC-75F256C |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | 3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| 中文描述： | EE PLD, 9.5 ns, PBGA256 |
| 封裝： | FPBGA-256 |
| 文件頁數(shù)： | 42/92頁 |
| 文件大?。?/td> | 378K |
| 代理商： | LC5256MC-75F256C |
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Lattice Semiconductor
ispXPLD 5000MX Family Data Sheet
42
HSTL_I_out
Using HSTL 2.5V,
Class I
t
IOBUF,
t
IOEN
,
t
IODIS
t
IOBUF,
t
IOEN
,
t
IODIS
t
IOBUF,
t
IOEN
,
t
IODIS
—
0.5
—
0.5
—
0.5
—
0.5
—
0.5
ns
HSTL_III_out
Using HSTL 2.5V,
Class III
—
0.6
—
0.6
—
0.6
—
0.6
—
0.6
ns
HSTL_IV_out
Using HSTL 2.5V,
Class IV
—
0.6
—
0.6
—
0.6
—
0.6
—
0.6
ns
LVDS_out
Using Low
Voltage Differen-
tial Signaling
(LVDS)
t
IOBUF,
t
IOEN
,
t
IODIS
—
0.8
—
0.8
—
0.8
—
0.8
—
0.8
ns
LVPECL_out
Using Low
Voltage PECL
t
IOBUF,
t
IOEN
,
t
IODIS
t
IOBUF,
t
IOEN
,
t
IODIS
t
IOBUF,
t
IOEN
,
t
IODIS
t
IOBUF,
t
IOEN
,
t
IODIS
t
IOBUF,
t
IOEN
,
t
IODIS
t
IOBUF,
t
IOEN
,
t
IODIS
—
0.3
—
0.3
—
0.3
—
0.3
—
0.3
ns
PCI_out
Using PCI
Standard
—
0.6
—
0.6
—
0.6
—
0.6
—
0.6
ns
SSTL2_I_out
Using SSTL 2.5V,
Class I
—
0.3
—
0.3
—
0.3
—
0.3
—
0.3
ns
SSTL2_II_out
Using SSTL 2.5V,
Class II
—
0.5
—
0.5
—
0.5
—
0.5
—
0.5
ns
SSTL3_I_out
Using SSTL 3.3V,
Class I
—
0.2
—
0.2
—
0.2
—
0.2
—
0.2
ns
SSTL3_II_out
Using SSTL 3.3V,
Class II
—
0.4
—
0.4
—
0.4
—
0.4
—
0.4
ns
ispXPLD 5000MX Family Timing Adders (Continued)
Parameter
Description
Base
Param.
-4
-45
-5
-52
-75
Units
Min. Max. Min. Max. Min. Max. Min. Max. Min. Max.
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PDF描述 |
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