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參數資料
| 型號： | LC5512MC-75F256C |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | 3.3V, 2.5V and 1.8V In-System Programmable eXpanded Programmable Logic Device XPLD⑩ Family |
| 中文描述： | EE PLD, 9.5 ns, PBGA256 |
| 封裝： | FPBGA-256 |
| 文件頁數： | 74/92頁 |
| 文件大小： | 378K |
| 代理商： | LC5512MC-75F256C |
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Lattice Semiconductor
ispXPLD 5000MX Family Data Sheet
74
Global Clock LVDS pair options: GCLK0 and GCLK1, as well as GCLK2 and GCLK3, can be paired together to
receive differencial clocks; where GCLK0 and GCLK3 are the positive LVDS inputs.
0
0
126N
126P
S26
S24
S13
S12
-
-
S27
S25
—
—
C4
D5
ispXPLD 5768MX Logic Signal Connections (Continued)
sysIO Bank LVDS Pair
Primary Macrocell/
Function
Alternate Outputs
Macrocell 1
Alternate
Inputs
256 fpBGA
Ball Number
484 fpBGA
Ball Number
Macrocell 2
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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