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參數(shù)資料
| 型號(hào)： | LD3985J24R |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | ULTRA LOW DROP-LOW NOISE BICMOS VOLTAGE REGULATORS LOW ESR CAPACITORS COMPATIBLE |
| 中文描述： | 超低壓降低噪聲BICMOS工藝電壓調(diào)節(jié)器兼容低ESR電容 |
| 文件頁(yè)數(shù)： | 3/14頁(yè) |
| 文件大?。?/td> | 393K |
| 代理商： | LD3985J24R |
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LD3985 SERIES
3/14
Figure 2: Connection Diagram
(top view for SOT and TSOT, top through view for Flip-Chip)
Table 4: Pin Description
Figure 3: Typical Application Circuit
Pin N°
SOT23-5L/
TSOT23-5L
Pin N°
Flip-Chip
Symbol
Name and Function
1
2
3
4
2
1
V
I
Input Voltage of the LDO
Common Ground
Inhibit Input Voltage: ON MODE when V
INH
≥
1.2V, OFF MODE when V
INH
≤
0.4V (Do not leave floating, not internally pulled down/up)
Bypass Pin: Connect an external capacitor (usually 10nF) to minimize noise
voltage
Output Voltage of the LDO
GND
V
INH
4
5
BYPASS
5
3
V
O
TSOT23-5L/SOT23-5L
Flip-Chip
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PDF描述 |
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參數(shù)描述 |
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