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參數(shù)資料
| 型號： | LFEC33E-4FN672I |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁數(shù)： | 132/163頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 32.8KLUTS 672FPBGA |
| 標準包裝： | 40 |
| 系列： | EC |
| 邏輯元件/單元數(shù)： | 32800 |
| RAM 位總計： | 434176 |
| 輸入/輸出數(shù)： | 496 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 672-BBGA |
| 供應商設備封裝： | 672-FPBGA（27x27） |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁當前第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁
4-4
Pinout Information
LatticeECP/EC Family Data Sheet
Pin Information Summary
LFEC1
LFEC3
LFECP6/EC6
LFECP/EC10
Pin Type
100-
TQFP
144-
TQFP
208-
PQFP
100-
TQFP
144-
TQFP
208-
PQFP
256-
fpBGA
144-
TQFP
208-
PQFP
256-
fpBGA
484-
fpBGA
208-
PQFP
256-
fpBGA
484-
fpBGA
Single Ended User
I/O
67
97
112
67
97
145
160
97
147
195
224
147
195
288
Differential Pair User
I/O
29
46
56
29
46
72
80
46
72
97
112
72
97
144
Configu-
ration
Dedicated
13
Muxed
48
56
TAP
5
555
5
Dedicated (total
without supplies)
80
110
160
80
110
160
208
110
160
208
373
160
208
373
VCC
2
3
2
3
10
4
10
20
6
10
20
VCCAUX
2
4
2
4
2
12
4
2
12
VCCPLL
0
000
0
VCCIO
Bank0
1
2
1
2
3
2
3
2
4
3
2
4
Bank1
1
2
1
2
4
2
4
Bank2
1
2
1
2
4
2
4
Bank3
1
2
1
2
4
2
4
Bank4
1
2
1
2
4
2
4
Bank5
1
2
1
2
3
2
4
3
2
4
Bank6
1
2
1
2
4
2
4
Bank7
1
2
1
2
4
2
4
GND, GND0-GND7
8
13
8
13
16
20
14
18
20
44
20
44
NC
0
2
51
0
2
9
35
0
4
0
139
0
75
Single
Ended/
Differen-
tial I/O
Pair per
Bank
Bank 0
11/5
14/7
16/8
11/5
14/7
26/13 32/16
14/7
26/13 32/16
32/16 26/13 32/16 48/24
Bank 1
11/5
13/6
16/8
11/5
13/6
16/8
13/6
17/8
18/9
32/16
17/8
18/9
32/16
Bank 2
3/1
8/4
3/1
8/4
14/7
16/8
8/4
14/7
16/8
14/7
16/8
32/16
Bank 3
8/4
13/6
16/8
8/4
13/6
16/8
13/6
16/8
32/16
16/8
32/16 32/16
Bank 4
12/4
14/6
16/8
12/4
14/6
16/8
14/6
17/8
32/16
17/8
32/16
Bank 5
9/4
13/6
16/8
9/4
13/6
26/13 32/16
13/6
26/13 32/16
32/16 26/13 32/16 48/24
Bank 6
5/2
14/7
16/8
5/2
14/7
16/8
14/7
16/8
32/16
16/8
32/16 32/16
Bank 7
8/4
15/7
16/8
8/4
15/7
16/8
15/7
16/8
32/16
VCCJ
1
111
1
Note: During configuration the user-programmable I/Os are tri-stated with an internal pull-up resistor enabled. If any pin is not used (or not
bonded to a package pin), it is also tri-stated with an internal pull-up resistor enabled after configuration.
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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