- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377634 > LFECP1E-5T144C (Lattice Semiconductor Corporation) 12-Bit 66 kSPS ADC Ser. Out, Pgrmable MSB/LSB First, Pgrmable Power Down/Output Data Length, 11 Ch 20-CDIP -55 to 125 PDF資料下載
參數(shù)資料
| 型號(hào)： | LFECP1E-5T144C |
| 廠商： | Lattice Semiconductor Corporation |
| 英文描述： | 12-Bit 66 kSPS ADC Ser. Out, Pgrmable MSB/LSB First, Pgrmable Power Down/Output Data Length, 11 Ch 20-CDIP -55 to 125 |
| 中文描述： | LatticeECP / EC的系列數(shù)據(jù)手冊(cè) |
| 文件頁數(shù)： | 54/117頁 |
| 文件大?。?/td> | 557K |
| 代理商： | LFECP1E-5T144C |
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3-18
DC and Switching Characteristics
LatticeECP/EC Family Data Sheet
Lattice Semiconductor
EBR Memory Timing Diagrams
Figure 3-9. Read/Write Mode (Normal)
Note: Input data and address are registered at the positive edge of the clock and output data appears after the positive edge of the clock.
Figure 3-10. Read/Write Mode with Input and Output Registers
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output is only updated during a read cycle
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Mem(n) data from previous read
Mem(n) data from previous read
DIA
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DOA (Regs)
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ACCESS
t
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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