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參數(shù)資料
| 型號(hào)： | LFXP3E-4T100C |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁(yè)數(shù)： | 162/397頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 3.1KLUTS 62I/O 100-TQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | XP |
| 邏輯元件/單元數(shù)： | 3000 |
| RAM 位總計(jì)： | 55296 |
| 輸入/輸出數(shù)： | 62 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類(lèi)型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 100-LQFP |
| 供應(yīng)商設(shè)備封裝： | 100-TQFP（14x14） |
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LatticeECP/EC and LatticeXP
Lattice Semiconductor
DDR Usage Guide
10-25
--*******DDR Output register *******************************************
component ODDRXB
port(
CLK
: in STD_LOGIC;
DA
: in STD_LOGIC;
DB
: in STD_LOGIC;
LSR
: in STD_LOGIC;
Q
: out STD_LOGIC);
end component;
--*******Bidirectional Buffer********************************************
component BB
port(
I
: in STD_LOGIC;
T
: in STD_LOGIC;
O
: out STD_LOGIC;
B
: inout STD_LOGIC);
end component;
--******DQS DLL Component*************************************************
component DQSDLL
port(
CLK
: in STD_LOGIC;
RST
: in STD_LOGIC;
UDDCNTL
: in STD_LOGIC;
LOCK
: out STD_LOGIC;
DQSDEL
: out STD_LOGIC);
end component;
--****** DQS Delay block***************************************************
component DQSBUFB
port(
DQSI
: in STD_LOGIC;
CLK
: in STD_LOGIC;
READ
: in STD_LOGIC;
DQSDEL
: in STD_LOGIC;
DQSO
: out STD_LOGIC;
DDRCLKPOL
: out STD_LOGIC;
DQSC
: out STD_LOGIC;
PRMBDET
: out STD_LOGIC);
end component;
signal dqsbuf : std_logic;
signal dqsdel : std_logic;
signal ddrclkpol_sig : std_logic;
signal ddrin : std_logic_vector(7 downto 0 );
signal ddrout : std_logic_vector(7 downto 0 );
signal tridata : std_logic_vector(7 downto 0 );
signal dqsout : std_logic;
signal tridqs : std_logic;
signal dqsin : std_logic;
signal vcc_net : std_logic;
signal gnd_net : std_logic;
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PDF描述 |
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