參數(shù)資料
型號(hào)： LFXP3E-4TN144I
廠商： Lattice Semiconductor Corporation
文件頁(yè)數(shù)： 91/397頁(yè)
文件大?。?/td> 0K
描述： IC FPGA 3.1KLUTS 144TQFP
標(biāo)準(zhǔn)包裝： 60
系列： XP
邏輯元件/單元數(shù)： 3000
RAM 位總計(jì)： 55296
輸入/輸出數(shù)： 100
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-TQFP（20x20）
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9-15
Memory Usage Guide
Lattice Semiconductor
LatticeECP/EC and LatticeXP Devices
Table 9-6. True Dual Port RAM Attributes for LatticeECP/EC and LatticeXP
The True Dual Port RAM (RAM_DP_TRUE) can be configured as NORMAL, READ BEFORE WRITE or WRITE
THROUGH modes. Each of these modes affects what data comes out of the port Q of the memory during the write
operation followed by the read operation at the same memory location. The READ BEFORE WRITE attribute is
supported for x9 and x18 data widths. Detailed discussions of the WRITE modes and the constraints of the True
Dual Port can be found in Appendix A.
Additionally users can select to enable the output registers for RAM_DP_TRUE. Figures 8-15 through 8-20 show
the internal timing waveforms for the True Dual Port RAM (RAM_DP_TRUE) with these options.
Attribute
Description
Values
Default
Value
User Selectable
Through
IPexpress
DATA_WIDTH_A
Data Word Width Port A
1, 2, 4, 9, 18
1
YES
DATA_WIDTH_B
Data Word Width Port B
1, 2, 4, 9, 18
1
YES
REGMODE_A
Register Mode (Pipelining) for Port A
NOREG, OUTREG
NOREG
YES
REGMODE_B
Register Mode (Pipelining) for Port B
NOREG, OUTREG
NOREG
YES
RESETMODE
Selects the Reset type
ASYNC, SYNC
ASYNC
YES
CSDECODE_A
Chip Select Decode for Port A
000, 001, 010, 011, 100, 101,
110, 111
000
NO
CSDECODE_B
Chip Select Decode for Port B
000, 001, 010, 011, 100, 101,
110, 111
000
NO
WRITEMODE_A
Read / Write Mode for Port A
NORMAL, WRITETHROUGH,
READBEFOREWRITE
NORMAL
YES
WRITEMODE_B
Read / Write Mode for Port B
NORMAL, WRITETHROUGH,
READBEFOREWRITE
NORMAL
YES
GSR
Global Set Reset
ENABLED, DISABLED
ENABLED
YES
相關(guān)PDF資料
PDF描述
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LFXP3C-4TN144I IC FPGA 3.1KLUTS 100I/O 144-TQFP
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NBSG16VSMNG IC RCVR/DRIVER SIGE DIFF 16QFN
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LFXP3E-5T144C 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 3.1K LUTs 100 IO 1.2 V -5 Spd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
LFXP3E-5TN100C 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 3.1K LUTs 62 IO 1.2V -5 Spd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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