參數(shù)資料
型號： LMX2332LSLDX
廠商： NATIONAL SEMICONDUCTOR CORP
元件分類： XO, clock
英文描述： PLLatinumTM Low Power Dual Frequency Synthesizer for RF Personal Communications
中文描述： PLL FREQUENCY SYNTHESIZER, 1200 MHz, QCC20
封裝： THIN, CSP-20
文件頁數(shù)： 17/23頁
文件大?。?/td> 553K
代理商： LMX2332LSLDX
Functional Description
(Continued)
SERIAL DATA INPUT TIMING
01280610
Note 1:
Parenthesis data indicates programmable reference divider data.
Data shifted into register on clock rising edge.
Data is shifted in MSB first.
Note 2:
t
cs
= Data to Clock Set-Up Time
t
CH
= Data to Clock Hold Time
t
CWH
= Clock Pulse Width High
t
CWL
= Clock Pulse Width Low
t
ES
= Clock to Load Enable Set-Up Time
t
EW
= Load Enable Pulse Width
Test Conditions:
The Serial Data Input Timing is tested using a symmetrical waveform around V
CC
/2. The test waveform has an edge rate of 0.6 V/ns with
amplitudes of 2.2V
@
V
CC
= 2.7V and 2.6V
@
V
CC
= 5.5V.
PHASE COMPARATOR AND INTERNAL CHARGE PUMP CHARACTERISTICS
01280611
Notes:
Phase difference detection range: 2
π
to +2
π
The minimum width pump up and pump down current pulses occur at the D
o
pin when the loop is locked.
R16 = HIGH
L
www.national.com
17
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PDF描述
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參數(shù)描述
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