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參數(shù)資料
| 型號(hào)： | LP62S1024AX-55LLI |
| 廠商： | AMIC Technology Corporation |
| 英文描述： | ER 22C 18#16 4#12 PIN PLUG |
| 中文描述： | 128K的× 8位低電壓CMOS的SRAM |
| 文件頁(yè)數(shù)： | 11/17頁(yè) |
| 文件大?。?/td> | 189K |
| 代理商： | LP62S1024AX-55LLI |
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LP62S1024A-T Series
(August, 2001, Version 1.0)
11
AMIC Technology, Inc.
AC Test Conditions
Input Pulse Levels
0.4V to 2.4V
Input Rise and Fall Time
5 ns
Input and Output Timing Reference Levels
1.5V
Output Load
See Figures 1 and 2
30pF
* Including scope and jig.
* Including scope and jig.
C
L
TTL
5pF
C
L
TTL
Data Retention Characteristics
(T
A
= -25
°
C to 85
°
C)
Figure 1. Output Load
Figure 2. Output Load for t
CLZ1
,
t
CLZ2
, t
OHZ
, t
OLZ
, t
CHZ1
,
t
CHZ2
, t
WHZ
, and t
OW
Symbol
Parameter
Min.
Max.
Unit
Conditions
V
DR1
2.0
3.6
V
CE1
≥
VCC - 0.2V
V
DR2
VCC for Data Retention
2.0
3.6
V
CE2
≤
0.2V,
I
CCDR1
Data Retention Current
-
3*
μ
A
VCC = 2V,
CE1
≥
VCC - 0.2V,
V
IN
≥
0V
I
CCDR2
-
3*
μ
A
VCC = 2V,
CE2
≤
0.2V,
V
IN
≥
0V
t
CDR
Chip Disable to Data Retention Time
0
-
ns
See Retention Waveform
t
R
Operation Recovery Time
5
-
ms
*
LP62S1024A-55LLT/70LLT
I
CCDR
: max. 3
μ
A at T
A
= 0
°
C to + 40
°
C
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| LP62S1024AX-70LLI | 128K X 8 BIT LOW VOLTAGE CMOS SRAM |
| LP62S1024AX-70LLT | 128K X 8 BIT LOW VOLTAGE CMOS SRAM |
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| LP62S1024AU-55LLT | 128K X 8 BIT LOW VOLTAGE CMOS SRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| LP62S1024AX-70LLT | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:128K X 8 BIT LOW VOLTAGE CMOS SRAM |
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