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參數資料
| 型號： | LP62S1664CU-70LLT |
| 廠商： | AMIC Technology Corporation |
| 英文描述： | 64K X 16 BIT LOW VOLTAGE CMOS SRAM |
| 中文描述： | 64K的× 16位低電壓CMOS的SRAM |
| 文件頁數： | 12/15頁 |
| 文件大?。?/td> | 148K |
| 代理商： | LP62S1664CU-70LLT |
LP62S1664C Series
PRELIMINARY
(February, 2002, Version 0.0)
11
AMIC Technology, Inc.
AC Test Conditions
Input Pulse Levels
0V to 2.4V
Input Rise And Fall Time
5 ns
Input and Output Timing Reference Levels
1.5V
Output Load
See Figures 1 and 2
30pF
* Including scope and jig.
* Including scope and jig.
C
L
TTL
5pF
C
L
TTL
Data Retention Characteristics
(T
A
= -25
°
C to 85
°
C for –LLT or -40
°
C to 85
°
C for -LLI)
Figure 1. Output Load
Figure 2. Output Load for
t
CLZ
,
t
OLZ
,
t
CHZ
,
t
OHZ
,
t
WHZ
,
and
t
OW
Symbol
Parameter
Min.
Max.
Unit
Conditions
V
DR
VCC for Data Retention
2.0
3.6
V
CE
≥
VCC - 0.2V
I
CCDR
Data Retention Current
-
3*
μ
A
VCC = 2.0V,
CE
≥
VCC - 0.2V
V
IN
≥
0V
t
CDR
Chip Disable to Data Retention Time
0
-
ns
t
R
Operation Recovery Time
t
RC
-
ns
See Retention Waveform
t
VR
VCC Rise Time from Data Retention
Voltage to Operating Voltage
5
-
ms
* LP62S1664C-55/70(LLT/LLI)
I
CCDR
: max. 1
μ
A at T
A
= 0
°
C to + 40
°
C
相關PDF資料 |
PDF描述 |
|---|---|
| LP62S1664C | 64K X 16 BIT LOW VOLTAGE CMOS SRAM |
| LP62S1664CV-55LLI | 64K X 16 BIT LOW VOLTAGE CMOS SRAM |
| LP62S1664CV-55LLT | 64K X 16 BIT LOW VOLTAGE CMOS SRAM |
| LP62S1664CV-70LLI | 64K X 16 BIT LOW VOLTAGE CMOS SRAM |
| LP62S1664CV-70LLT | 64K X 16 BIT LOW VOLTAGE CMOS SRAM |
相關代理商/技術參數 |
參數描述 |
|---|---|
| LP62S1664CV-55LLI | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:64K X 16 BIT LOW VOLTAGE CMOS SRAM |
| LP62S1664CV-55LLT | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:64K X 16 BIT LOW VOLTAGE CMOS SRAM |
| LP62S1664CV-70LLI | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:64K X 16 BIT LOW VOLTAGE CMOS SRAM |
| LP62S1664CV-70LLT | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:64K X 16 BIT LOW VOLTAGE CMOS SRAM |
| LP62S2048A-I | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:256K X 8 BIT LOW VOLTAGE CMOS SRAM |
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