參數(shù)資料
型號: LPC47M14W-NC
廠商: SMSC Corporation
英文描述: SNAP LOCK CABLE MARKER - J (10PK)
中文描述: 128引腳ENGANCED超級I / O與LPC接口和USB集線器控制器
文件頁數(shù): 63/205頁
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代理商: LPC47M14W-NC
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SMSC DS – LPC47M14X
Page 63
Rev. 05/02/2000
Table 30 – Interrupt Control Table
FIFO
MODE
ONLY
INTERRUPT
IDENTIFICATION
REGISTER
INTERRUPT SET AND RESET FUNCTIONS
BIT 3
BIT 2
BIT 1
BIT 0
PRIORITY
LEVEL
INTERRUPT
TYPE
INTERRUPT
SOURCE
INTERRUPT
RESET
CONTROL
-
0
0
0
1
-
None
None
0
1
1
0
Highest
Receiver Line
Status
Overrun Error,
Parity Error,
Framing Error or
Break Interrupt
Reading the Line
Status Register
0
1
0
0
Second
Received Data
Available
Receiver Data
Available
Read Receiver
Buffer or the FIFO
drops below the
trigger level.
1
1
0
0
Second
Character
Timeout
Indication
No Characters
Have Been
Removed From or
Input to the RCVR
FIFO during the
last 4 Char times
and there is at
least 1 char in it
during this time
Reading the
Receiver Buffer
Register
0
0
1
0
Third
Transmitter
Holding
Register Empty
Transmitter
Holding Register
Empty
Reading the IIR
Register (if Source
of Interrupt) or
Writing the
Transmitter
Holding Register
0
0
0
0
Fourth
MODEM
Status
Clear to Send or
Data Set Ready or
Ring Indicator or
Data Carrier
Detect
Reading the
MODEM Status
Register
LINE CONTROL REGISTER (LCR)
Address Offset = 3H, DLAB = 0, READ/WRITE
Start LSB Data 5-8 bits MSB Parity
Stop
Serial Data
This register contains the format information of the serial line. The bit definitions are:
Bits 0 and 1
These two bits specify the number of bits in each transmitted or received serial character. The encoding of bits 0 and 1
is as follows:
The Start, Stop and Parity bits are not included in the word length.
BIT 1
BIT 0
WORD LENGTH
0
0
1
1
1
8 Bits
0
1
0
5 Bits
6 Bits
7 Bits
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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