參數(shù)資料
型號： LPC47N227MN
英文描述： Peripheral IC
中文描述： 外圍芯片
文件頁數(shù)： 175/228頁
文件大?。?/td> 1269K
代理商： LPC47N227MN
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SMSC DS – LPC47M192
Page 175
Rev. 03/30/05
DATASHEET
Table 67 – I/O Base Address Configuration Register Description
LOGICAL
DEVICE
INDEX
(Note 1)
FDC
0x60,0x61
[0x0100:0x0FF8]
ON 8 BYTE
BOUNDARIES
LOGICAL
DEVICE
NUMBER
0x00
REGISTER
BASE I/O
RANGE
FIXED
BASE OFFSETS
+0 : SRA
+1 : SRB
+2 : DOR
+3 : TDR
+4 : MSR/DSR
+5 : FIFO
+7 : DIR/CCR
n/a
n/a
+0 : Data/ecpAfifo
+1 : Status
+2 : Control
+400h : cfifo/ecpDfifo/tfifo/cnfgA
+401h : cnfgB
+402h : ecr
0x01
0x02
0x03
Reserved
Reserved
Parallel
Port
n/a
n/a
n/a
n/a
[0x0100:0x0FFC]
ON 4 BYTE
BOUNDARIES
(EPP Not supported)
or
[0x0100:0x0FF8]
ON 8 BYTE
BOUNDARIES
(all modes supported,
EPP is only available
when the base address
is on an 8-byte
boundary)
0x60,0x61
+3 : EPP Address
+4 : EPP Data 0
+5 : EPP Data 1
+6 : EPP Data 2
+7 : EPP Data 3
+0 : RB/TB/LSB div
+1 : IER/MSB div
+2 : IIR/FCR
+3 : LCR
+4 : MSR
+5 : LSR
+6 : MSR
+7 : SCR
+0 : RB/TB/LSB div
+1 : IER/MSB div
+2 : IIR/FCR
+3 : LCR
+4 : MSR
+5 : LSR
+6 : MSR
+7 : SCR
n/a
+0 : Data Register
+4 : Command/Status Reg.
0x04
Serial Port 1
0x60,0x61
[0x0100:0x0FF8]
ON 8 BYTE
BOUNDARIES
0x05
Serial Port 2
0x60,0x61
[0x0100:0x0FF8]
ON 8 BYTE
BOUNDARIES
0x06
0x07
Reserved
KYBD
n/a
n/a
n/a
Not Relocatable
Fixed Base Address:
60,64
n/a
[0x0100:0x0FFF]
on 1 byte boundaries
0x08
0x09
Reserved
Game Port
n/a
n/a
+00: Game Port Register
0x60,0x61
相關(guān)PDF資料
PDF描述
LPC47M10X Microcontroller
LPC47M182 Microprocessor Crystal; Frequency:19.6608MHz; Frequency Tolerance:20ppm; Load Capacitance:18pF; Crystal Terminals:Radial Leaded; ESR:25ohm; Leaded Process Compatible:Yes; Mounting Type:Through Hole; No. of Pins:2 RoHS Compliant: Yes
LPC47N350 LEGACY FREE KEYBOARD EMBEDDED CONTROLLER WITH SPI AND LPC DOCKING INTERFACE
LPC47N217 64 - PIN SUPUR I/O WITH LPC INTERFACE
LPC47N217-JN 64 - PIN SUPUR I/O WITH LPC INTERFACE
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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