參數資料
型號： LT1720CS8#TR
廠商： Linear Technology
文件頁數： 8/28頁
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描述： IC COMP DUAL R-R 4MA 4.5NS 8SOIC
標準包裝： 2,500
系列： UltraFast™
類型： 通用
元件數： 2
輸出類型： CMOS，滿擺幅，TTL
電壓 - 電源，單路/雙路(±)： 2.7 V ~ 6 V
電壓 - 輸入偏移（最小值）： 3mV @ 5V
電流 - 輸入偏壓（最小值）： 6µA @ 5V
電流 - 輸出（標準）： 20mA
電流 - 靜態(tài)（最大值）： 7mA
CMRR, PSRR（標準）： 70dB CMRR，80dB PSRR
傳輸延遲（最大）： 10ns
磁滯： 7mV
工作溫度： 0°C ~ 70°C
封裝/外殼： 8-SOIC（0.154"，3.90mm 寬）
安裝類型： 表面貼裝
包裝： 帶卷 (TR)
LT1720/LT1721
16
17201fc
The circuit in Figure 9 shows a crystal oscillator circuit
that generates two nonoverlapping clocks by making full
use of the two independent comparators of the LT1720.
C1 oscillates as before, but with a lower reference level,
C2’s output will toggle at different times. The resistors set
the degree of separation between the output’s high pulses.
With the values shown, each output has a 44% high and
56% low duty cycle, sufcient to allow 2ns between the
high pulses. Figure 10 shows the two outputs.
APPLICATIONS INFORMATION
The optional A1 feedback network shown can be used to
force identical output duty cycles. The steady state duty
cycles of both outputs will be 44%. Note, though, that
the addition of this network only adjusts the percentage
of time each output is high to be the same, which can be
important in switching circuits requiring identical settling
times. It cannot adjust the relative phases between the two
outputs to be exactly 180° apart, because the signal at the
input node driven by the crystal is not a pure sinusoid.
Figure 8. Timing Skew of Figure 7’s Circuit
SUPPLY VOLTAGE (V)
2.5
OUTPUT
SKEW
(ps)
4.5
6.0
1000
800
600
400
200
0
1720/21 F08
3.5
5.5
3.0
4.0
5.0
Figure 10. Nonoverlapping Outputs of Figure 9’s Circuit
Figure 9. Crystal-Based Nonoverlapping 10MHz Clock Generator
–
+
–
+
–
+
C1
1/2 LT1720
C2
1/2 LT1720
A1
LT1636
VCC
2.7V TO 6V
2k
620Ω
220Ω
10MHz
CRYSTAL (AT-CUT)
100k
2.2k
1.3k
2k
1k
17201 F09
0.1μF
OUTPUT 0
OUTPUT 1
GROUND
CASE
OPTIONAL—
SEE TEXT
20ns/DIV
Q1
2V/DIV
Q0
2V/DIV
17201 F10
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PDF描述
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