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參數(shù)資料
| 型號： | LTC1392IS8#TRPBF |
| 廠商： | Linear Technology |
| 文件頁數(shù)： | 6/12頁 |
| 文件大?。?/td> | 252K |
| 描述： | IC DATA ACQ SYSTEM 10BIT 8-SOIC |
| 標準包裝： | 2,500 |
| 功能： | 溫度監(jiān)控系統(tǒng)（傳感器） |
| 傳感器類型： | 內(nèi)部 |
| 感應(yīng)溫度： | -40°C ~ 85°C |
| 精確度： | ±4°C |
| 拓撲： | ADC，多路復(fù)用器，電壓基準 |
| 輸出類型： | 并聯(lián)，串行 |
| 輸出警報： | 無 |
| 輸出風(fēng)扇： | 無 |
| 電源電壓： | 4.5 V ~ 6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-SOIC（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 8-SOIC |
| 包裝： | 帶卷 (TR) |
6
LTC1392
TEST CIRCUITS
Voltage Waveforms for t
dis
D
OUT
WAVEFORM 1
(SEE NOTE 1)
2.0V
t
dis
90%
10%
D
OUT
WAVEFORM 2
(SEE NOTE 2)
CS
NOTE 1: WAVEFORM 1 IS FOR AN OUTPUT WITH INTERNAL CONDITIONS SUCH
THAT THE OUTPUT IS HIGH UNTIL DISABLED BY THE OUTPUT CONTROL.
NOTE 2: WAVEFORM 2 IS FOR AN OUTPUT WITH INTERNAL CONDITIONS SUCH
THAT THE OUTPUT IS LOW UNTIL DISABLED BY THE OUTPUT CONTROL.
LTC1392 " TC06
APPLICATIONS INFORMATION
U
U
U
DIGITAL CONSIDERATIONS
Serial Interface
The LTC1392 communicates with microprocessors and
other external circuitry via a synchronous, half-duplex,
3-wire serial interface (see Figure 1). The clock (CLK)
synchronizes the data transfer with each bit being trans-
mitted on the falling CLK edge and captured on the rising
CLK edge in both transmitting and receiving systems. The
input data is first received and then the A/D conversion
result is transmitted (half-duplex). Half-duplex operation
allows D
IN
and D
OUT
to be tied together allowing transmis-
sion over three wires: CS, CLK and DATA (D
IN
/D
OUT
). Data
transfer is initiated by a falling chip select (CS) signal. After
the falling CS is recognized, an 80祍 delay is needed for
The LTC1392 is a micropower data acquisition system
designed to measure temperature, an on-chip power
supply voltage and a differential input voltage. The LTC1392
contains the following functional blocks:
1. On-chip temperature sensor
2. 10-bit successive approximation capacitive ADC
3. Bandgap reference
4. Analog multiplexer (MUX)
5. Sample-and-hold (S/H)
6. Synchronous, half-duplex serial interface
7. Control and timing logic
Load Circuit for t
dDO
, t
r
and t
f
D
OUT
1.4V
3k
100pF
TEST POINT
LTC1392 " TC02
Voltage Waveforms for D
OUT
Delay Time, t
dDO
CLK
D
OUT
V
IL
t
dDO
V
OL
V
OH
LTC1392 " TC03
Load Circuit for t
dis
and t
en
D
OUT
3k
100pF
TEST POINT
5V t
dis
WAVEFORM 2, t
en
t
dis
WAVEFORM 1
LTC1392 " TC05
Voltage Waveforms for D
OUT
Rise and Fall Times, t
r
and t
f
D
OUT
V
OL
V
OH
t
r
t
f
1392 TC04
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