參數(shù)資料
型號： LTC2415-1IGN#TRPBF
廠商： Linear Technology
文件頁數(shù)： 7/40頁
文件大?。?/td> 0K
描述： IC ADC 24BIT DIFFINPUT/REF16SSOP
標(biāo)準(zhǔn)包裝： 2,500
位數(shù)： 24
采樣率（每秒）： 13.75
數(shù)據(jù)接口： MICROWIRE?，串行，SPI?
轉(zhuǎn)換器數(shù)目： 2
功率耗散（最大）： 1mW
電壓電源： 單電源
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 16-SSOP（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 16-SSOP
包裝： 帶卷 (TR)
輸入數(shù)目和類型： 1 個差分，雙極
LTC2415/LTC2415-1
15
sn2415 24151fs
Table 2. LTC2415/LTC2415-1 Output Data Format
Differential Input Voltage
Bit 31
Bit 30
Bit 29
Bit 28
Bit 27
Bit 26
Bit 25
…
Bit 0
VIN*
EOC
DMY
SIG
MSB
VIN* ≥ 0.5 VREF**
0
0110
0
…
0
0.5 VREF** – 1LSB
0
0101
1
…
1
0.25 VREF**
0
0101
0
…
0
0.25 VREF** – 1LSB
0
0100
1
…
1
0
0100
0
…
0
–1LSB
0
0011
1
…
1
– 0.25 VREF**
0
0011
0
…
0
– 0.25 VREF** – 1LSB
0
0010
1
…
1
– 0.5 VREF**
0
0010
0
…
0
VIN* < –0.5 VREF**
0
0001
1
…
1
*The differential input voltage VIN = IN
+ – IN–.
**The differential reference voltage VREF = REF
+ – REF–.
Figure 3. Output Data Timing
APPLICATIO S I FOR ATIO
WU
U
MSB
SIG
“0”
12
3
4
5
26
27
32
BIT 0
BIT 27
BIT 5
LSB24
BIT 28
BIT 29
BIT 30
SDO
SCK
CS
EOC
BIT 31
SLEEP
DATA OUTPUT
CONVERSION
2415 F03
Hi-Z
VCC (V)
2.5
OFFSET
(ppm)
50
0
–50
–100
–150
–200
–250
3.0
3.5
4.0
4.5
2415 F04
5.0
5.5
VREF = 2.5V
TA = 25°C
PART NO.1
PART NO.2
PART NO.3
TEMPERATURE (
°C)
–50
OFFSET
ERROR
(ppm
OF
V
REF
)
–103.8
–104.0
–104.2
–104.4
–104.6
–25
0
25
50
2415 F05
75
100
VCC AND VREF (V)
2.7
OFFSET
ERROR
(ppm
OF
V
REF
)
–103.0
–103.5
–104.0
–104.5
–105.0
–105.5
3.5
4.3
4.7
2415 F06
3.1
3.9
5.1
5.5
VCC = 5V
VREF = 5V
REF+ = 5V
REF– = GND
VIN = 0V
IN+ = GND
IN– = GND
FO = GND
TA =100°C
TA = –50°C
TA =25°C
Figure 4. Offset vs VCC
Figure 5. Offset vs Temperature
Figure 6. Offset vs VCC (VREF = VCC)
While the variation in offset with supply voltage is propor-
tional to VCC (see Figure 4), several characteristics of this
variation can be used to eliminate the effects. First, the
variation with respect to supply voltage is linear. Second,
the magnitude of the offset error decreases with de-
creased supply voltage. Third, the offset error increases
with increased reference voltage with an equal and oppo-
site magnitude to the supply voltage variation. As a result,
by tying VCC to VREF, the variation with supply can be
nearly eliminated, see Figure 6. The variation with supply
is less than 2ppm over the entire 2.7V to 5.5V supply
range.
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PDF描述
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