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參數(shù)資料
| 型號： | LTC6915CDE#TRPBF |
| 廠商： | Linear Technology |
| 文件頁數(shù)： | 5/18頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PGA DIGITAL PREC 0DRFT 12DFN |
| 標準包裝： | 2,500 |
| 放大器類型： | 儀表 |
| 電路數(shù)： | 1 |
| 輸出類型： | 滿擺幅 |
| 轉(zhuǎn)換速率： | 0.2 V/µs |
| 增益帶寬積： | 200kHz |
| 電流 - 輸入偏壓： | 4nA |
| 電壓 - 輸入偏移： | 5µV |
| 電流 - 電源： | 1.73mA |
| 電壓 - 電源，單路/雙路(±)： | 2.7 V ~ 11 V，±1.35 V ~ 5.5 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 12-WFDFN 裸露焊盤 |
| 供應商設備封裝： | 12-DFN-EP（4x3） |
| 包裝： | 帶卷 (TR) |
LTC6915
13
6915fb
operaTion
DOUT is always active in serial mode (never tri-stated).
This simplifies the daisy chaining of the multiple devices.
DOUTcannotbe“wire-or”tootherSPIoutputs.Inaddition,
DOUT does not return to zero at the end of transmission,
i.e. when CS is pulled high.
A LTC6915 may be daisy-chained with other LTC6915s
or other devices having serial interfaces by connecting
the DOUT to the DIN of the next chip while CLK and CS
remain common to all chips in the daisy chain. The serial
data is clocked to all the chips then the CS signal is pulled
high to update all of them simultaneously. Figure 4
shows an example of two LTC6915s in a daisy chained SPI
configuration.
Figure 1. PGA in the Parallel Control Mode
Figure 2. Bidirectional Nature of DOUT/D3 Pin
Figure 3. Diagram of Serial Interface (MSB First Out)
4-BIT GAIN
CONTROL CODE
4-BIT
LATCH
Q0 Q1 Q2 Q3 Q4 Q5 Q6 Q7
8-BIT
SHIFT-REGISTER
DOUT
(D3)
CLK
DIN
CS
6915 F03
V–
V+
DGND
DOUT(D3)
6915 F02
(INTERNAL
NODE)
SHDN
IN–
IN+
V–
HOLD_THRU
CS(D0)
DIN(D1)
CLK(D2)
V+
OUT
SENSE
REF
NC
P/S
DGND
DOUT(D3)
LTC6915
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
VOUT
VIN
0.1F
PARALLEL GAIN CONTROL CODE = 1010
VOUT = 29 VIN = 512VIN
SHDN
IN–
IN+
V–
HOLD_THRU
CS(D0)
DIN(D1)
CLK(D2)
V+
OUT
SENSE
REF
NC
P/S
DGND
DOUT(D3)
LTC6915
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
VOUT
VIN
0.1F
GAIN IS SET BY MICROPROCESSOR. A 10k RESISTOR
ON DOUT(D3) PROTECT THE DEVICE WHEN VD3 > V+
P
5V
D0
D1
D2
D3
10k
6915 F01
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