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參數(shù)資料
| 型號(hào)： | M1A3P600-1PQG208I |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 13824 CLBS, 600000 GATES, PQFP208 |
| 封裝： | 28 X 28 MM, 3.40 MM HEIGHT, 0.50 MM PITCH, GREEN, PLASTIC, QFP-208 |
| 文件頁數(shù)： | 136/218頁 |
| 文件大小： | 6270K |
| 代理商： | M1A3P600-1PQG208I |
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ProASIC3 DC and Switching Characteristics
2- 10
v1.4
Power Consumption of Various Internal Resources
Table 2-14 Different Components Contributing to Dynamic Power Consumption in ProASIC3 Devices
Parameter
Definition
Device Specific Dynamic Contributions
(W/MHz)
A3
P100
0
A3
P600
A3
P400
A3
P250
A3
P125
A3
P060
A3
P030
A3
P015
PAC1
Clock contribution of a Global Rib
14.50 12.80 12.80 11.00 11.00 9.30
9.30 9.30
PAC2
Clock contribution of a Global Spine
2.48
1.85
1.35
1.58
0.81
0.41 0.41
PAC3
Clock contribution of a VersaTile row
0.81
PAC4
Clock contribution of a VersaTile used as a
sequential module
0.12
PAC5
First contribution of a VersaTile used as a
sequential module
0.07
PAC6
Second contribution of a VersaTile used as a
sequential module
0.29
PAC7
Contribution of a VersaTile used as a
combinatorial Module
0.29
PAC8
Average contribution of a routing net
0.70
PAC9
Contribution of an I/O input pin (standard
dependent)
See Table 2-8 on page 2-6 through
PAC10
Contribution of an I/O output pin (standard
dependent)
See Table 2-11 on page 2-8 through
PAC11
Average contribution of a RAM block during
a read operation
25.00
PAC12
Average contribution of a RAM block during
a write operation
30.00
PAC13
Dynamic contribution for PLL
2.60
Note: *For a different output load, drive strength, or slew rate, Actel recommends using the Actel Power
spreadsheet calculator or SmartPower tool in Libero Integrated Design Environment (IDE) software.
Table 2-15 Different Components Contributing to the Static Power Consumption in ProASIC3 Devices
Parameter
Definition
Device Specific Static Power (mW)
A3
P10
00
A3
P60
0
A3
P40
0
A3
P25
0
A3
P12
5
A3
P06
0
A3
P03
0
A3
P01
5
PDC1
Array static power in Active mode
PDC2
I/O input pin static power (standard-dependent)
See Table 2-8 on page 2-6 through
PDC3
I/O output pin static power (standard-dependent)
See Table 2-11 on page 2-8 through
PDC4
Static PLL contribution
2.55 mW
PDC5
Bank quiescent power (VCCI-dependent)
Note: *For a different output load, drive strength, or slew rate, Actel recommends using the Actel
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M1A3P600-1PQG208 | FPGA, 13824 CLBS, 600000 GATES, 350 MHz, PQFP208 |
| M1A3P600-2FG144I | FPGA, 13824 CLBS, 600000 GATES, PBGA144 |
| M1A3P600-2FG144 | FPGA, 13824 CLBS, 600000 GATES, 350 MHz, PBGA144 |
| M1A3P600-2FG256I | FPGA, 13824 CLBS, 600000 GATES, PBGA256 |
| M1A3P600-2FG256 | FPGA, 13824 CLBS, 600000 GATES, 350 MHz, PBGA256 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| M1A3P600-1VQ144 | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| M1A3P600-1VQ144ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| M1A3P600-1VQ144I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| M1A3P600-1VQ144PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| M1A3P600-1VQG144 | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
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