Revision 13 2-15 Figure 2-5 Tristate Output Buffer Timing Model and Delays (example) D CLK Q D CLK Q
參數(shù)資料
型號(hào)： M1A3PE3000-FGG896
廠商： Microsemi SoC
文件頁數(shù)： 85/162頁
文件大小： 0K
描述： IC FPGA 1KB FLASH 3M 896-FBGA
標(biāo)準(zhǔn)包裝： 27
系列： ProASIC3E
RAM 位總計(jì)： 516096
輸入/輸出數(shù)： 620
門數(shù)： 3000000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 896-BGA
供應(yīng)商設(shè)備封裝： 896-FBGA（31x31）
ProASIC3E Flash Family FPGAs
Revision 13
2-15
Figure 2-5 Tristate Output Buffer Timing Model and Delays (example)
D
CLK
Q
D
CLK
Q
10% VCCI
tZL
Vtrip
50%
tHZ
90% VCCI
tZH
Vtrip
50%
tLZ
50%
EOUT
PAD
D
E
50%
tEOUT (R)
50%
tEOUT (F)
PAD
DOUT
EOUT
D
I/O Interface
E
tEOUT
tZLS
Vtrip
50%
tZHS
Vtrip
50%
EOUT
PAD
D
E
50%
tEOUT (R)
tEOUT (F)
50%
VCC
VCCI
VCC
VOH
VOL
tZL, tZH, tHZ, tLZ, tZLS, tZHS
tEOUT = MAX(tEOUT(r), tEOUT(f))
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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