Revision 13 2-61 Output DDR Module Figure 2-32 Output DDR Timing Model Table 2-91 Parameter De" />
參數(shù)資料
型號： M1A3PE3000L-1FGG896
廠商： Microsemi SoC
文件頁數(shù)： 136/162頁
文件大?。?/td> 0K
描述： IC FPGA 1KB FLASH 3M 896-FBGA
標準包裝： 27
系列： ProASIC3EL
RAM 位總計： 516096
輸入/輸出數(shù)： 620
門數(shù)： 3000000
電源電壓： 1.14V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 896-BGA
供應商設備封裝： 896-FBGA（31x31）
ProASIC3E Flash Family FPGAs
Revision 13
2-61
Output DDR Module
Figure 2-32 Output DDR Timing Model
Table 2-91 Parameter Definitions
Parameter Name
Parameter Definition
Measuring Nodes (from, to)
tDDROCLKQ
Clock-to-Out
B, E
tDDROCLR2Q
Asynchronous Clear-to-Out
C, E
tDDROREMCLR
Clear Removal
C, B
tDDRORECCLR
Clear Recovery
C, B
tDDROSUD1
Data Setup Data_F
A, B
tDDROSUD2
Data Setup Data_R
D, B
tDDROHD1
Data Hold Data_F
A, B
tDDROHD2
Data Hold Data_R
D, B
Data_F
(from core)
CLK
CLKBUF
Out
FF2
INBUF
CLR
DDR_OUT
Output DDR
FF1
0
1
X
A
B
D
E
C
B
OUTBUF
Data_R
(from core)
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