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參數(shù)資料
| 型號： | M1AFS600-FGG484K |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 271/334頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 4MB FLASH 600K 484-FBGA |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 系列： | Fusion® |
| RAM 位總計(jì)： | 110592 |
| 輸入/輸出數(shù)： | 172 |
| 門數(shù)： | 600000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -55°C ~ 100°C |
| 封裝/外殼： | 484-BGA |
| 供應(yīng)商設(shè)備封裝： | 484-FPBGA（23x23） |
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Fusion Family of Mixed Signal FPGAs
Revision 4
2-25
Global Buffers with No Programmable Delays
The CLKBUF and CLKBUF_LVPECL/LVDS macros are composite macros that include an I/O macro
driving a global buffer, hardwired together (Figure 2-20).
The CLKINT macro provides a global buffer function driven by the FPGA core.
The CLKBUF, CLKBUF_LVPECL/LVDS, and CLKINT macros are pass-through clock sources and do not
use the PLL or provide any programmable delay functionality.
Many specific CLKBUF macros support the wide variety of single-ended and differential I/O standards
supported by Fusion devices. The available CLKBUF macros are described in the IGLOO, ProASIC3,
Figure 2-20 Global Buffers with No Programmable Delay
CLKBUF_LVDS/LVPECL Macro
PADN
PADP
YY
A
PAD
Y
CLKINT Macro
CLKBUF Macro
GLA
or
GLB
or
GLC
Clock Source
Clock Conditioning
Output
None
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EPF10K50EQC240-1N | IC FLEX 10KE FPGA 50K 240-PQFP |
| EPF10K50EQC240-1 | IC FLEX 10KE FPGA 50K 240-PQFP |
| GMC18DTEI | CONN EDGECARD 36POS .100 EYELET |
| AFS600-FG484K | IC FPGA 4MB FLASH 600K 484FBGA |
| ACM40DTMT | CONN EDGECARD 80POS R/A .156 SLD |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| M1AFS600-FGG484XZ | 制造商:Microsemi Corporation 功能描述: |
| M1AFS600-FPQ208 | 制造商:Microsemi Corporation 功能描述:FPGA FUSION 600K GATES 130NM 1.5V 208PQFP - Trays |
| M1AFS600-FPQ256ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS600-FPQ256I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS600-FPQ256PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
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