2-94 Revision 23 1.2 V DC Core Voltage Table 2-165 Input DDR Propagation Delays <tfoot id="i22hw"><label id="i22hw"><dfn id="i22hw"></dfn></label></tfoot><var id="i22hw"></var>
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    參數(shù)資料
    

    


    


    
型號(hào)：
M1AGL600V5-FGG484

    

    
廠商：
Microsemi SoC

    

    
文件頁數(shù)：
14/250頁

    

    
文件大?。?/td>
0K

    

    
描述：
IC FPGA 1KB FLASH 600K 484-FBGA

    

    
標(biāo)準(zhǔn)包裝：
60

    

    
系列：
IGLOO

    

    
邏輯元件/單元數(shù)：
13824
    		

    

    
RAM 位總計(jì)：
110592
    		

    

    
輸入/輸出數(shù)：
235
    		

    

    
門數(shù)：
600000
    		

    

    
電源電壓：
1.425 V ~ 1.575 V
    		

    

    
安裝類型：
表面貼裝
    		

    

    
工作溫度：
0°C ~ 70°C
    		

    

    
封裝/外殼：
484-BGA
    		

    

    
供應(yīng)商設(shè)備封裝：
484-FPBGA（23x23）
    		

    

    

    

	
    
    
    
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    IGLOO DC and Switching Characteristics
    2-94
    Revision 23
    1.2 V DC Core Voltage
    Table 2-165  Input DDR Propagation Delays
    Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.14 V
    Parameter
    Description
    Std.
    Units
    tDDRICLKQ1
    Clock-to-Out Out_QR for Input DDR
    0.76
    ns
    tDDRICLKQ2
    Clock-to-Out Out_QF for Input DDR
    0.94
    ns
    tDDRISUD1
    Data Setup for Input DDR (negedge)
    0.93
    ns
    tDDRISUD2
    Data Setup for Input DDR (posedge)
    0.84
    ns
    tDDRIHD1
    Data Hold for Input DDR (negedge)
    0.00
    ns
    tDDRIHD2
    Data Hold for Input DDR (posedge)
    0.00
    ns
    tDDRICLR2Q1
    Asynchronous Clear-to-Out Out_QR for Input DDR
    1.23
    ns
    tDDRICLR2Q2
    Asynchronous Clear-to-Out Out_QF for Input DDR
    1.42
    ns
    tDDRIREMCLR
    Asynchronous Clear Removal Time for Input DDR
    0.00
    ns
    tDDRIRECCLR
    Asynchronous Clear Recovery Time for Input DDR
    0.24
    ns
    tDDRIWCLR
    Asynchronous Clear Minimum Pulse Width for Input DDR
    0.19
    ns
    tDDRICKMPWH
    Clock Minimum Pulse Width High for Input DDR
    0.31
    ns
    tDDRICKMPWL
    Clock Minimum Pulse Width Low for Input DDR
    0.28
    ns
    FDDRIMAX
    Maximum Frequency for Input DDR
    160.00
    MHz
    Note: For specific junction temperature and voltage supply levels, refer to Table 2-7 on page 2-7 for derating values.
    
    
    
    
    
    


    


    

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AGL600V5-FG484
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A54SX32A-TQG176
IC FPGA SX 48K GATES 176-TQFP

    

    
A54SX32A-TQ176
IC FPGA SX 48K GATES 176-TQFP

    

    
A1010B-PQG100C
IC FPGA 1200 GATES 100-PQFP COM

    

    
ABC43DRYN-S93
CONN EDGECARD 86POS DIP .100 SLD

    

    

    

    


    


    

    相關(guān)代理商/技術(shù)參數(shù)
    		

    參數(shù)描述
    		

    
    

    
M1AGL600V5-FGG484I
功能描述:IC FPGA 1KB FLASH 600K 484-FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:IGLOO 產(chǎn)品培訓(xùn)模塊:Three Reasons to Use FPGA's in Industrial Designs
	Cyclone IV FPGA Family Overview 特色產(chǎn)品:Cyclone? IV FPGAs 標(biāo)準(zhǔn)包裝:60 系列:CYCLONE® IV GX LAB/CLB數(shù):9360 邏輯元件/單元數(shù):149760 RAM 位總計(jì):6635520 輸入/輸出數(shù):270 門數(shù):- 電源電壓:1.16 V ~ 1.24 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:484-BGA 供應(yīng)商設(shè)備封裝:484-FBGA（23x23）

    

    
M1AGL600V5-FQN144
 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO Low-Power Flash FPGAs with Flash Freeze Technology

    

    
M1AGL600V5-FQN144ES
 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO Low-Power Flash FPGAs with Flash Freeze Technology

    

    
M1AGL600V5-FQN144I
 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO Low-Power Flash FPGAs with Flash Freeze Technology

    

    
M1AGL600V5-FQN144PP
 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:IGLOO Low-Power Flash FPGAs with Flash Freeze Technology

    

    
    
    
    
	
    	
    
    
     
     
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                                    *數(shù)量
                                    廠商
                                    批號(hào)
                                    封裝
                                  
    
                                    
                                
                                
    
                                    
                                        
    
                                            
                                            
                                        
    
                                        		
                                     
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                  
    
                                  
                                   
                                    
                            
    
                             
                             
							                            
    
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    我的聯(lián)系方式
    
                     
                     
                       
    
                                
                                
                                
    
                                    
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