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參數(shù)資料
| 型號： | M30240M6-XXXXFP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, OTPROM, MICROCONTROLLER, PQFP80 |
| 封裝： | 0.80 MM PITCH, PLASTIC, QFP-80 |
| 文件頁數(shù)： | 333/380頁 |
| 文件大?。?/td> | 4328K |
| 代理商： | M30240M6-XXXXFP |
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Frequency Synthesizer Circuit
M30240 Group
Rev.1.00 Sep 24, 2003 Page 38 of 360
1.2.17 Frequency Synthesizer Circuit
The Frequency Synthesizer Circuit generates a 48MHz clock needed by the USB block and a clock fSYN
that are both a multiple of the external input reference clock f(XIN). A block diagram of the circuit is shown
in Figure 1.23.
Figure 1.23: Frequency Synthesizer Circuit
The frequency synthesizer consists of a prescaler, frequency multiplier macro, a frequency divider
macro, and five registers, namely FSP, FSM, FSC, FSD, and FSCCR. Clock f(XIN) is prescaled down
using FSP to generate fPIN. fPIN is multiplied using FSM to generate an fVCO clock which is then divided
using FSD to produce the clock fSYN. The fVCO clock is optimized for 48 MHz operation and is buffered
and sent out of the frequency synthesizer block as signal fUSB. This signal is used by the USB block.
1.2.17.1 Prescaler
Clock fPIN is a divided down version of clock f(XIN) (see Figure 1.24). The relationship between fPIN
and the clock input to the prescaler f(XIN) is as follows:
fPIN = f(XIN) / 2(n+1) where n is a decimal number between 0 and 254.
Setting FSP to 255 disables the prescaler and fPIN = f(XIN).
Note: f(XIN) frequency below 1 MHz is not recommended.
Figure 1.24: Frequency Synthesizer Prescaler Register (FSP)
FSP
Data Bus
FSM
FSC
FSD
03DE
03DD
03DC
03DF
Frequency
Multiplier
Frequency
Divider
8
B
it
LS
8 Bit
f(XIN)
fVCO
fSYN
fUSB
Prescaler
8
B
it
fPIN
FSCCR
FSCCR0
03DB
EN
USBC5
2
fPIN
FSP
f(Xin)
Dec(n)
Hex(n)
12 MHz
255
FF
12.00 MHz
1 MHz
5
05
12.00 MHz
2 MHz
2
02
12.00 MHz
3 MHz
1
01
12.00 MHz
6 MHz
0
00
12.00 MHz
MSB
7
LSB
0
Bit 6
Bit 1
Bit 0
Bit 2
Bit 5
Bit 4
Bit 3
Bit 7
Access: R/W
Address: 03DE16
Reset:
FF16
f(XIN)/2(n+1) = fPIN
相關PDF資料 |
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相關代理商/技術參數(shù) |
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