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參數(shù)資料
| 型號(hào)： | M30610EC |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER |
| 中文描述： | 單片16位CMOS微機(jī) |
| 文件頁(yè)數(shù)： | 69/197頁(yè) |
| 文件大?。?/td> | 2673K |
| 代理商： | M30610EC |
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Mitsubishi microcomputers
M16C / 61 Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
DMAC
69
(3) The priorities of channels and DMA transfer timing
If a DMA transfer request signal falls on a single sampling cycle (a sampling cycle means one period from
the leading edge to the trailing edge of BCLK), the DMA request bits of applicable channels concurrently
turn to 1. If the channels are active at that moment, DMA0 is given a high priority to start data transfer.
When DMA0 finishes data transfer, it gives the bus right to the CPU. When the CPU finishes single bus
access, then DMA1 starts data transfer and gives the bus right to the CPU.
An example in which DMA transfer is carried out in minimum cycles at the time when DMA transfer
request signals due to external factors concurrently occur.
Figure 1.15.5 An example of DMA transfer effected by external factors.
Figure 1.15.5. An example of DMA transfer effected by external factors
BCLK
AAAA
AAAA
DMA0
AAAA
DMA1
DMA0
request bit
DMA1
request bit
AAA
AAA
AAAAA
AAAAA
AAAAAA
AAAAAA
CPU
INT0
INT1
Obtainm
An example in which DMA transmission is carried out in minimum
cycles at the time when DMA transmission request signals due to
external factors concurrently occur.
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