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參數(shù)資料
| 型號： | M30624MGA-322FP |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | QUID+OSINE FUNCTION |
| 中文描述： | 單片16位CMOS微機(jī) |
| 文件頁數(shù)： | 38/274頁 |
| 文件大?。?/td> | 3495K |
| 代理商： | M30624MGA-322FP |
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Mitsubishi microcomputers
M16C / 62A Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
Clock Generating Circuit
38
Pin
Memory expansion mode
Microprocessor mode
Single-chip mode
Address bus, data bus, CS0 to CS3
RD, WR, BHE, WRL, WRH
HLDA, BCLK
ALE
Port
CLK
OUT
When fc selected
When f
8
, f
32
selected
Retains status before stop mode
“H”
“H”
“H”
Retains status before stop mode
Retains status before stop mode
Valid only in single-chip mode
Valid only in single-chip mode
“H”
Retains status before stop mode
Table 1.10.2. Port status during stop mode
Clock Output
In single-chip mode, the clock output function select bits (bits 0 and 1 at address 0006
16
) enable f
8
, f
32
, or
fc to be output from the P5
7
/CLK
OUT
pin. When the WAIT peripheral function clock stop bit (bit 2 at address
0006
16
) is set to “1”, the output of f
8
and f
32
stops when a WAIT instruction is executed.
Stop Mode
Writing “1” to the all-clock stop control bit (bit 0 at address 0007
16
) stops all oscillation and the microcom-
puter enters stop mode. In stop mode, the content of the internal RAM is retained provided that V
CC
re-
mains above 2V.
Because the oscillation , BCLK, f
1
to f
32
, f
1SIO2
to f
32SIO2
, f
C
, f
C32
, and f
AD
stops in stop mode, peripheral
functions such as the A-D converter and watchdog timer do not function. However, timer A and timer B
operate provided that the event counter mode is set to an external pulse, and UARTi(i = 0 to 2), SI/O3,4
functions provided an external clock is selected. Table 1.10.2 shows the status of the ports in stop mode.
Stop mode is cancelled by a hardware reset or an interrupt. If an interrupt is to be used to cancel stop mode,
that interrupt must first have been enabled. If returning by an interrupt, that interrupt routine is executed.
When shifting from high-speed/medium-speed mode to stop mode and at a reset, the main clock division
select bit 0 (bit 6 at address 0006
16
) is set to “1”. When shifting from low-speed/low power dissipation mode
to stop mode, the value before stop mode is retained.
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PDF描述 |
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