參數(shù)資料
型號： M38503E4SP
元件分類： 微控制器/微處理器
英文描述： 8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PDIP42
封裝： 0.600 INCH, 1.78 MM PITCH, PLASTIC, SDIP-42
文件頁數(shù)： 269/286頁
文件大?。?/td> 3016K
代理商： M38503E4SP
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HARDWARE
3850 Group (Spec. H) User’s Manual
FUNCTIONAL DESCRIPTION
1-64
Status Register 1 (SRD1)
Status register 1 indicates the status of serial communications, re-
sults from ID checks and results from check sum comparisons. It can
be read after the SRD by writing the read status register command
(7016). Also, status register 1 is cleared by writing the clear status
register command (5016).
Table 19 gives the definition of each status register bit. “0016” is out-
put when power is turned on and the flag status is maintained even
after the reset.
Boot Update Completed Bit (SR15)
This flag indicates whether the control program was downloaded to
the RAM or not, using the download function.
Status Register (SRD)
The status register indicates operating status of the flash memory
and status such as whether an erase operation or a program ended
successfully or in error. It can be read by writing the read status
register command (7016). Also, the status register is cleared by writ-
ing the clear status register command (5016).
Table 18 gives the definition of each status register bit. After clearing
the reset, the status register outputs “8016”.
Sequencer status (SR7)
After power-on and recover from deep power down mode, the se-
quencer status is set to “1”(ready).
The sequencer status indicates the operating status of the device.
This status bit is set to “0” (busy) during write or erase operation and
is set to “1” upon completion of these operations.
Erase Status (SR5)
The erase status reports the operating status of the auto erase op-
eration. If an erase error occurs, it is set to “1”. When the erase sta-
tus is cleared, it is set to “0”.
Program Status (SR4)
The program status reports the operating status of the auto write
operation. If a write error occurs, it is set to “1”. When the program
status is cleared, it is set to “0”.
SRD0 bits
SR7 (bit7)
SR6 (bit6)
SR5 (bit5)
SR4 (bit4)
SR3 (bit3)
SR2 (bit2)
SR1 (bit1)
SR0 (bit0)
Definition
“1”
“0”
Table 18 Status register (SRD)
Table 19 Status register 1 (SRD1)
00
Not verified
01
Verification mismatch
10
Reserved
11
Verified
SR15 (bit7)
SR14 (bit6)
SR13 (bit5)
SR12 (bit4)
SR11 (bit3)
SR10 (bit2)
SR9 (bit1)
SR8 (bit0)
Boot update completed bit
Reserved
Checksum match bit
ID check completed bits
Data reception time out
Reserved
“1”
Update completed
-
Match
Time out
-
“0”
Not Update
-
Mismatch
Normal operation
-
Definition
SRD1 bits
Status name
Sequencer status
Reserved
Erase status
Program status
Reserved
Ready
-
Terminated in error
-
Busy
-
Terminated normally
-
Check Sum Consistency Bit (SR12)
This flag indicates whether the check sum matches or not when a
program is downloaded for execution using the download function.
ID Check Completed Bits (SR11 and SR10)
These flags indicate the result of ID checks. Some commands can-
not be accepted without an ID check.
Data Reception Time Out (SR9)
This flag indicates when a time out error is generated during data
reception. If this flag is attached during data reception, the received
data is discarded and the microcomputer returns to the command
wait state.
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PDF描述
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