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參數(shù)資料
| 型號： | M3V-R24V2AJFREQ2 |
| 元件分類： | XO, clock |
| 英文描述： | VCXO, CLOCK, 60.001 MHz - 160 MHz, CMOS/TTL OUTPUT |
| 文件頁數(shù)： | 2/2頁 |
| 文件大?。?/td> | 70K |
| 代理商： | M3V-R24V2AJFREQ2 |
17
V
C
X
O
1. Frequencies above 70 MHz utilize a PLL design. Fundamental and PLL designs are available at other frequencies. Contact factory.
2. Symmetry is measured at 1.4 V with TTL load, and at 50% Vdd with HCMOS load.
3. TTL load - see load circuit diagram #1 on page 148. HCMOS load - see load circuit diagram #2 on page 148.
4. Rise/Fall times are measured between 0.5 V and 2.4 V with TTL load, and between 10% Vdd and 90% Vdd with HCMOS load.
M3V Series
9x14 mm, 3.3 Volt, HCMOS/TTL, VCXO
Revision B, 4-13-04
相關(guān)PDF資料 |
PDF描述 |
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| M3V-R16V2CJFREQ2 | VCXO, CLOCK, 60.001 MHz - 160 MHz, CMOS OUTPUT |
| M3V-R12V2CJFREQ2 | VCXO, CLOCK, 60.001 MHz - 160 MHz, CMOS OUTPUT |
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參數(shù)描述 |
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